《数字电路与逻辑设计》综合练习new

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1、1．用代数法化简下列函数为最简与或表达式F＝B＋B＋AC（1）F＝＋CD＋D＋C（2）F＝AB＋AB＋C＋AC（3）F＝A＋＋2．将下列函数式化为最小项表达式F＝AB＋BC＋AC（1）F＝＝AB＋BC3．用反演规则（1）F＝（A＋）（B＋）（C＋D）＝（＋B）（＋C）（＋A）（2）F＝A·＝·4．卡诺图法化简下列函数为最简与或式（1）F＝C＋AD＋（B＋C）＋A＋5.设A、B、C三个逻辑变量代表三位裁判，A为裁判长，逻辑“1”表示按下按键，逻辑“0”表示未按按键；Y=1表示举重成功（灯亮、或铃响），Y=0表示举重失败（灯不亮、或铃不响）。1．按下图所示求出F的逻辑式，并将其化简成最

2、简与或式。解：按图求得：F=BCD·B·D+D化简得：F=BCD+B+D+D=CD+B+D=C+B+D1．分析如下电路，写出F的最简与或式（用卡诺图化简F）。解：F=∑（2，4，6，7）卡诺图化简如下：F＝BC＋AC＋AB2．CMOS线路图如图所示，写出F的逻辑式，说明它是何种门电路。解：F＝＝功能：为或非门3．电路如图所示，试对应于A、B、C端的波形画出该电路的输出波形。解：4．下图中片0－4均为译码器，指出当输入代码为A4A3A2A1A0=10101时，片0-3中的哪一片工作？该片中的哪一条输出线有效？解：∵A4A3＝10＝（A1A0）片4∴（Y2）片4有效，从而使片2工作。又

3、因：A2A1A0＝101＝（A2A1A0）片2，所以片2的输出线Y5有效。5．分析如下逻辑图，求出Y1、Y2的逻辑式，列出真值表，指出逻辑功能。解：ABY1Y20000011010101101功能：半加器Y1＝A⊕BY2＝A·B1．分析用四选一数据选择器构成的电路，写出Y的最简与或式。解：Y＝I0＋BI1＋AI2＋ABI3＝＋BC＋A＋ABC用卡诺图化简Y＝C＋＋BC或Y＝＋BC＋2．分析如下电路，写出逻辑式，列出真值表，指出逻辑功能。解：F1（A、B、C）=Σ（1、2、4、7）F2（A、B、C）=Σ（3、5、6、7）ABCF1F20000000110010100110110010

4、101011100111111由真值表看出，它是全加器，F1为本位和，F2为向高位的进位。五、分析下列电路1．试用一个四选一数据选择器设计实现下述逻辑功能的组合电路。解：设计电路如下：2．用8选1数据选择器实现逻辑函数F=å（2，4，5，7）。解：实现电路如下：1．用3-8线译码器实现逻辑函数F=A＋AC＋B。解：F=A＋AC＋B＝直接画图得：2．试用下图所示的4选1数据选择器设计一组合电路。从电路的输入端（A、B、C、D）输入余3BCD码，输出为F。当输入十进制数码0、2、4、5、7的对应余3BCD码时，F=1；输入其它余3BCD码时，F=0。（输入端允许用反变量）解：（1）依题

5、意列真值表：ABCDF0000000100100011010001010110011110001001101010111100110111101111ффф1010110100ффф（2）画卡诺图ABCD000111100100110111111φφφφφφAB000111110111111φφφφφφF＝＋D5.6．取片（1）和片（2）的S1作为第四个代码输入端A3，片（1）和片（2）的3个代码输入端A2，A1，A0接在一起作为4线—16线译码器的3个代码输入端A2，A1，A0。同时使两片的==0，如图所示。7．8．六、试画出下列各题波形1．试画出如下逻辑电路的P端输出波形，要求

6、对应CP输入时钟和A输入波形画出输出波形P。已知维持阻塞D触发器的初始状态为“1”（忽略触发器的传输延迟时间）。解：2．由主从JK触发器组成的逻辑电路如下图所示，试对应CP波形画出Q的波形。（设触发器的初始态为“0”，且画图时忽略触发器的延迟时间）。解：3．逻辑电路及CP、A的电压波形如下图所示，试画出Q的波形。（设触发器的初始态为“1”，且不考虑器件的传输延迟时间）。解：七、分析下列时序电路1．用主从JK触发器画出两级串入—串/并出单向移存器（可加用门电路）。并对应于CP和DO画出Q1、Q0的波形。（设Q1、Q0的初态为“0”）。解：；逻辑图2．由T1161组成的时序逻辑电路如下

7、图所示，请对应CK波形画出输出Q0Q1Q2Q3的波形。解：3．用T4195连接成的电路如图所示，试分析该电路，列出状态表，指出其功能、F端的脉码序列及其循环周期。解：QCQBQADA＝J＝K＝QC⊕QB001001011011011111101100100100100000电路为三位m序列发生器，由F端产生的m序列是00101110010111······。循环周期P＝23－1＝71．用T4195连接成的电路如下图所示，试分析该电路，列出状态表，画出完整状态图，并指出