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《7年《数字逻辑与数字系统》期末考试试题(a)》由会员上传分享,免费在线阅读,更多相关内容在工程资料-天天文库。
1、--北京邮电大学2007——2008学年第一学期--------《数字逻辑与数字系统》期末考试试题(A)------一、学生参加考试须带学生证或学院证明,未带者不准进入考场。学生必----须按照监考教师指定座位就坐。--考试--二、书本、参考资料、书包等与考试无关的东西一律放到考场指定位置。--注意-三、学生不得另行携带、使用稿纸,要遵守《北京邮电大学考场规则》,有--事项--考场违纪或作弊行为者,按相应规定严肃处理。--:--名四、所有试题写在答题纸上,试卷与答卷均上交。----姓考试--考试时间年月日--课程---题号一二三四五六七八总分线-----满分-------得
2、分-----:阅卷--号--教师--序--内订班一、选择题(每小题1分,共20分。答案写在答题纸上)---------1.下列函数中,与(A+B)(A+C)等价的逻辑函数是--------A.F=ABB.F=A+BC.A+BCD.F=B+C-------2.函数F的卡诺图如表1-1。其最简与或表达式是---装---A.F=ABD+ABD+ACDAB--CD00011110--:0011---号B.F=ABC+ACD+ABD--学011--111-----C.F=ABC+ABD+ACD1011----表1-1---D.F=ABD+ABD+ABD--------3.八进制数(5
3、73.4)8转化为十六进制数后为________。---:----级A.(17C.4)16B.(16B.4)16C.(17B.8)16D.(17B.4)16--班------4.与最小项ABCD相邻的逻辑最小项有__________个。-------A.1B.2C.4D.155.下列电路中,不属于组合逻辑电路的是(A)编码器;(B)译码器;(C)数据选择器;(D)计数器。6.图1-1为数据选择器构成的函数发生器,其输出逻辑Y等于(A)Y=AB;(B)Y=AB;(C)Y=A;(D)Y=B。图1-17.图1-2所示的译码显示电路中,输入Q3Q2Q1Q0为8421BCD码。设显示
4、信号高电平有效,则此刻LaLbLcLdLeLfLg=A.0110000B.0000110C.0000000D.1111111图1-28.图1-3为某RS触发器,此时Q的状态为(A)0;(B)1;(C)保持;(D)不定。图1-32n+1nQ=Q9.图1-4中,经CP脉冲作用后欲使,则A、B输入应为_____。A.A=0,B=0AJQBB.A=0,B=1KQC.A=1,B=1CPD.B=1图1-410.实现一个十进制的可逆计数器,至少需要__________个触发器。A.3B.4C.5D.6PSNSZ11.某时序电路的状态转移如表1-2,该电路Q3Q2Q1Q3Q2Q100000
5、10是模_______的计数器。00101000100110A.4B.5C.6D.801110001000001101110011001011111010表1-212.4个触发器构成的环形计数器,最多可有__________个有效状态。A.4B.16C.8D.1013.时序电路中不可缺少的部分为A.组合电路B.记忆电路C.同步时钟信号D.组合电路和记忆电路14、ispLSI器件中,巨块是指_____________。A.GLBB.全局布线区C.输出逻辑宏单元D.GLB及对应的ORC、IOC的总和。15.一个ispLSI1032中,共有_______个通用逻辑块。3A.4B.
6、8C.32D.6416.HDL编程时,括号可以改变运算次序,如设A=(010)2、B=(100)2,则A#(B$A)的结果为_____A.(100)2B.(010)2C.(110)2D.(011)217.数字系统的初步设计通常指A设计控制器B设计ASM图C子系统的设计D子系统的划分18.某RAM的地址寄存器字长为10,数据寄存器字长8,则存储容量为A256个存储单元B256×10个存储单元C1024×8个存储元D1024×256个存储元19双向数据总线常采用_____构成。A数据分配器B数据选择器C三态门D译码器20.ASM流程图是设计_____的一种重要工具。A控制器B运
7、算器C计数器D存储器。二、简答题(每小题6分,共18分)1、简述逻辑函数常用的表示方法。2、简述ABLE模块的组成要素及对应的关键字。3、画出图2-1状态机的ASM流程图。4三、组合逻辑电路分析(11分)某逻辑电路如图3-1所示。AF1、写出输出函数F的表达式。BC2、列出真值表。3、分析该电路的逻辑功能。图3-1四、组合逻辑设计(11分)已知某组合逻辑电路的输入A、B、C及输出F的波形如图4-1所示。1、列出真值表。2、画出卡诺图,写出最简逻辑函数表达式。图4-13、画出用与非门实现的电路图,。五、时序逻辑分析(
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