S3C2440基本特性

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1、第4章S3C2440基本特性與嵌入式系統設計大綱4.1S3C2440基本特性4.2S3C2440硬體資源4.3S3C2440記憶體與位置空間分配4.4以S3C2440為核心之嵌入式系統設計4.5結論2大綱4.1S3C2440基本特性4.2S3C2440硬體資源4.3S3C2440記憶體與位置空間分配4.4以S3C2440為核心之嵌入式系統設計4.5結論34.1S3C2440基本特性S3C2440微處理機是Samsung公司以ARM為架構所推出的ARM920T的微處理器核心。其基本特性包含下列各點：擁有16K的資料快取和16K的指令快取

2、，MMU快取固定的32-bits運算碼寬度，降低編碼數量所產生的消耗，減輕解碼和管線化的負擔大多均為一個時脈週期執行強大的索引定址模式精簡，且快速的2-priority-level中斷子系統，具有可切換的暫存器組支援ARM處理器16-bit(Thumb)指令模式44.1S3C2440基本特性S3C2440的優點：32-bitARM920T核心，工作頻率為499MHz（最高工作頻率：533MHz）系統時脈：內部PLL產生400~533MHzCPU內核工作頻率，外部匯流排頻率：100~133MHz核心電壓為1.3V，低功率消耗採用AMBA

3、（AdvancedMicrocontrollerBusArchitecture），使用0.13μm的CMOS製造技術和記憶體編譯器（MemoryCompiler）製造。可適用於PDA、攜帶型媒體播放器、衛星導航等產品5大綱4.1S3C2440基本特性4.2S3C2440硬體資源4.3S3C2440記憶體與位置空間分配4.4以S3C2440為核心之嵌入式系統設計4.5結論64.2S3C2440硬體資源圖4.3ARM920T內部架構圖74.2S3C2440硬體資源ARM920T內核是由ARM9TDMI，記憶體管理單元（MMU）和Cache

4、記憶體三部分組成。ARM920T：有兩個輔助運算器：CP14和CP15。CP14用於除錯控制。CP15用於記憶體系統控制以及測試控制。MMU：其功能管理虛擬記憶體，快取記憶體：是由獨立的16KB位址和16KB資料高速Cache組成。84.2S3C2440硬體資源圖4.4S3C2440硬體方塊架構示意圖94.2S3C2440硬體資源S3C2440內部資源(1)：內部大約是1.2V，1.8V/2.5V/3.3V記憶體，3.3V外部I/O微處理器，其包含16KBI-Cache/16KBDCache/MMU外部記憶體控制器(SDRAM控制與晶

5、片選擇邏輯)具備獨立專用DMA的LCD控制器(高達4K色彩STN與256K色彩TFT)具備外部請求接腳的4-chDMA控制器3-chUART(IrDA1.0，64-ByteTxFIFO以及64-ByteRxFIFO)2-chSPlIIC匯流排介面(支援多主控端架構)IIS語音CODEC介面104.2S3C2440硬體資源S3C2440內部資源(2)：AC97CODEC介面相容SD主機介面版本1.0與MMC協定版本2.112-chUSB主機控制器/1-chUSB裝置控制器(ver1.1)4-chPWM計時器/1-ch內部計時器/看門狗計

6、時器8-ch10-bitADC以及觸控螢幕介面具備萬年曆功能的RTCCamera介面(最高可支援4096x4096像素輸入。可支援縮放功能的2048x2048像素輸入)130個泛用I/O埠/24-ch外部中斷來源電源控制：正常，低功率消耗，中止以及睡眠模式具備PLL的內建時脈產生器11大綱4.1S3C2440基本特性4.2S3C2440硬體資源4.3S3C2440記憶體與位置空間分配4.4以S3C2440為核心之嵌入式系統設計4.5結論124.3S3C2440記憶體與位置空間分配圖4.5S3C2440記憶體映射分配圖134.3S3C

7、2440記憶體與位置空間分配S3C2440將系統的記憶體空間分為8個區(Bank)每個區塊的大小是128MB，因此總共是1GB。Bank0到Bank5的開始位址是固定的，用於ROM或SRAM。Bank6和Bank7用於ROM，SRAM或SDRAM，這兩個組是可以程式規劃，且大小相同。144.3S3C2440記憶體與位置空間分配S3C2440支援由NANDFLASH啟動。NANDFLASH具有容量大，比NORFlash價格低等特點。系統同時採用NANDFlash與SDRAM整合方式來設計的話，可獲得非常好的系統執行效能。由於Bank0是

8、以啟動ROM區塊(映射至0x0000_0000)工作，因此必須配置Bnak0（nGCS0）的資料匯流排寬度。寬度分為16-bit與32-bit。可以根據OM[1：0]在重置時的邏輯準位來決定。154.3S3C2440記憶