数字电路与逻辑设计试题及答案(试卷A)

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1、《数字集成电路基础》试题A（考试时间：120分钟）班级：姓名：学号：成绩：得分一、填空题（共20分）1.数字信号的特点是在上和上都是断续变化的，其高电平和低电平常用和来表示。2.常用的BCD码有、、等，常用的可靠性代码有、等。3.将十进制数45转换成8421码可得。4.同步RS触发器的特性方程为Qn+1=__________；约束方程为。5.数字电路按照是否有记忆功能通常可分为两类：、。6.当数据选择器的数据输入端的个数为8时，则其地址码选择端应有位。7．能将模拟信号转换成数字信号的电路，称为；而将能把数字信号转换成模拟信号的电路称为。8．时序逻辑电路按照其

2、触发器是否有统一的时钟控制分为时序电路和时序电路。9.两片中规模集成电路10进制计数器串联后，最大计数容量为位。得分二、单项选择题(共20分)1.对于四位二进制译码器，其相应的输出端共有。A．4个B.16个C.8个D.10个2.要实现,JK触发器的J、K取值应为。A．J=0，K=0B.J=0，K=1C.J=1，K=0D.J=1，K=13.图2.1所示是触发器的状态图。A.SRB.DC.TD.Tˊ图2.14．在下列逻辑电路中，不是组合逻辑电路的有。A.译码器B.编码器C.全加器D.寄存器75．欲使D触发器按Qn+1=n工作，应使输入D=。A.0B.1C.QD.

3、6．多谐振荡器可产生。A.正弦波B.矩形脉冲C.三角波D.锯齿波7.N个触发器可以构成最大计数长度（进制数）为的计数器。A.NB.2NC.N2D.2N8．随机存取存储器具有功能。A.读/写B.无读/写C.只读D.只写9．只读存储器ROM中的内容，当电源断掉后又接通，存储器中的内容。A.全部改变B.全部为0C.不可预料D.保持不变10.555定时器构成施密特触发器时，其回差电压为。A．VCCB.1/2VCCC.2/3VCCD.1/3VCC得分三、设计题(共20分)1、有一水箱由大、小两台水泵ML和MS供水，如图3.1所示，箱中设置了3个水位检测元件A、B、C。

4、水面低于检测元件时，检测元件给出高电平；水面高于检测元件时，检测元件给出低电平。现要求当水位超过C点时水泵停止工作；水位低于C点而高于B点时MS单独工作；水位低于B点而高于A点时ML单独工作；水位低于A点时ML和MS同时工作。试用门电路设计一个控制两台水泵的逻辑电路，要求电路尽量简单。MSMLABC图3.17得分四、简答题(共10分)图4.1555定时器的电气原理图如图4.1所示，当5脚悬空时，比较器C1和C2的比较电压分别为和。问：（1）当vI1>，vI2>时，比较器C1输出低电平，C2输出高电平，基本RS触发器（置0置1状态不变），放电三极管T导通

5、，输出端vO为低电平。（2）当vI1<，vI2<时，比较器C1输出高电平，C2输出低电平，基本RS触发器（置0置1状态不变），放电三极管T截止，输出端vO为高电平。（3）当vI1<，vI2>时，比较器C1输出，C2输出，即基本触发器（置0置1状态不变），电路亦保持原状态不变。得分五、分析作图题(共30分)1、设主从JK触发器的初始状态为0，触发器的触发翻转发生在时钟脉冲的下降沿，已知输入J、K的波形图如图5.1，（1）写出JK触发器的特性方程式；（2）画出输出Q的波形图。（10%）图5.172、74161集成计数器功能真值表如表5.1所示，其惯用符号

6、如图5.2所示，（1）利用反馈复位法将其构成十进制计数器；（2）利用反馈预置法将其构成8进制计数器。（20%）表5.1输入输出CPCrLDPTABCDQAQBQCQD×0×××××××0000↑10××ABCDABCD×110×××××保持×11×0××××保持↑1111××××计数QBQCQAQOQDCDBLDACPCrPT74161图5.27《数字集成电路基础》试题A评分标准一、填空题（每空1分，共20分）1、时间；数值；0；12、8421BCD；5421BCD；余3码；格雷码；奇偶校验码3、010001014、；5、组合逻辑电路；时序逻辑电路6、3位7

7、、A/D；D/A8、同步；异步9、100二、单项选择题(每题2分，共20分)12345678910BDCDDBDADD 三、设计题(共20分)解：一、列出满足逻辑要求的真值表并化简（化简方法可多种自选）ABCMSML0000000110010XX01101100XX101XX110XX11111化简得≥1&1ACBMsML二、作出逻辑电路图四、简答题(每题2分，共10分)7(1)置0；（2）置1；（3）高电平；高电平；状态不变五、分析作图题(共30分)1、共10分（1）（2）2、共20分解：（1）写出S10的二进制代码为SN=S10=1010写出反馈归零函数

8、,由于74161的异步置0信号为低电平0,因此QBQ