FPGAQuartus2宏功能模块应用

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1、EDA技术及其应用第4章宏功能模块应用4.1流水线乘法累加器设计4.1.1电路结构与工作原理图3-1流水线乘法累加器顶层设计4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-2定制新的宏功能块1.调用乘法器3.1流水线乘法累加器设计3.1.2电路结构与工作原理图3-3选择LPM宏功能模块1.调用乘法器3.1流水线乘法累加器设计3.1.2电路结构与工作原理图3-4设置乘法器参数1.调用乘法器4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-5设置乘法器结构类型1.调用乘法器4.1流

2、水线乘法累加器设计4.1.2电路结构与工作原理图3-6将LPM乘法器设置为流水线工作方式1.调用乘法器4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-7设置LPM加法器类型2.调用加法器和锁存器4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-8选择加法器数据输入类型2.调用加法器和锁存器4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-9为加法器增加进位输出2.调用加法器和锁存器4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-10为加法器增加流水线功能2

3、.调用加法器和锁存器4.1流水线乘法累加器设计4.1.2电路结构与工作原理图3-11为LPM寄存器选择D触发器类型2.调用加法器和锁存器4.1流水线乘法累加器设计4.1.3电路时序仿真与测试图3-12基于逻辑宏单元的设计报告4.1流水线乘法累加器设计4.1.3电路时序仿真与测试图3-13基于专用嵌入式乘法器模块的设计报告4.1流水线乘法累加器设计4.1.3电路时序仿真与测试图3-14基于逻辑宏单元的流水线乘法累加器时序分析报告4.1流水线乘法累加器设计4.1.3电路时序仿真与测试图3-15基于专用嵌

4、入式乘法器模块的流水线乘法累加器时序分析报告4.1流水线乘法累加器设计4.1.3电路时序仿真与测试图3-16MULTADD工程仿真波形4.2逻辑数据采样电路设计图3-17逻辑数据采样电路顶层设计3.2逻辑数据采样电路设计图3-18调用LPMRAM宏功能模块4.2逻辑数据采样电路设计图3-19LPMRAM参数设置4.2逻辑数据采样电路设计图3-20增加时钟使能控制4.2逻辑数据采样电路设计图3-21允许在系统存储器内容编辑器能对此RAM编辑4.2逻辑数据采样电路设计图3-22调用LPM计数器4.2逻辑

5、数据采样电路设计图3-23设置为加法计数器4.2逻辑数据采样电路设计图3-24设置为二进制计数器4.2逻辑数据采样电路设计图3-25增加异步清0控制4.2逻辑数据采样电路设计图3-26键入默认参数4.2逻辑数据采样电路设计图3-27加入默认参数4.2逻辑数据采样电路设计图3-28逻辑数据采样电路时序仿真波形4.3在系统存储器数据读写编辑器应用图3-29引脚锁定1.锁定引脚4.3在系统存储器数据读写编辑器应用图3-30In-SystemMemoryContentEditor编辑窗中硬件通信口设置2.打

6、开在系统存储单元编辑窗4.3在系统存储器数据读写编辑器应用图3-31In-SystemMemoryContentEditor扫描FPGA结果2.打开在系统存储单元编辑窗4.3在系统存储器数据读写编辑器应用图3-32In-SystemMemoryContentEditor上载FPGA中RAM数据3.读取RAM中的数据4.3在系统存储器数据读写编辑器应用图3-33利用In-SystemMemoryContentEditor读取LPM_RAM中数据3.读取RAM中的数据4.3在系统存储器数据读写编辑器应用

7、图3-34利用In-SystemMemoryContentEditor向LPM_RAM下载数据文件4.编辑下载RAM中的数据5.输入输出数据文件4.4简易正弦信号发生器设计图3-35正弦信号发生器结构框图4.4.1工作原理4.4简易正弦信号发生器设计4.4.2定制初始化数据文件1．建立.mif格式文件【例3-1】WIDTH=8;DEPTH=64;ADDRESS_RADIX=HEX;DATA_RADIX=HEX;CONTENTBEGIN0:FF;1:FE;2:FC;3:F9;4:F5;…（数据略去）3

8、D:FC;3E:FE;3F:FF;END;4.4简易正弦信号发生器设计4.4.2定制初始化数据文件1．建立.mif格式文件【例3-2】#include#include"math.h"main(){inti;floats;for(i=0;i<1024;i++){s=sin(atan(1)*8*i/1024);printf("%d:%d;",i,(int)((s+1)*1023/2));}}把上述程序编译成程序后，可在DOS命令行下执行命令：romg