数字电子技术实验(4)

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1、数字电子技术实验电工电子教学实验中心实验五移位寄存器及其应用实验内容任务：移位寄存器及应用⑴设计双向八位彩灯控制电路⑵4位串行加法电路设计选用器件:74LS194（双向移位寄存器）74LS74（D触发器）和少量门2片74LS194级联成8位左移或右移电路,SR2=QD1,SL1=QA2。2.为使灯点亮，总的移入数据：SR1=SL2=1。(1)(2)FF1FF2CP1CPD2参考电路⑴双向八位彩灯控制电路设计参考电路3.FF1的输出控制74LS194的移位方向，FF1构成了T’触发器，当有CP1时→FF1翻转→使74LS194换向移位。(1)(2)FF1F

2、F2CP1CPD2参考电路(1)(2)FF1FF2CP1CPD24.当8个灯未全亮时(D2=0)，每个CP的到来使→Q2=0;当8个灯全亮时(D2=1),下个CP来时→Q2’=0→灯全灭。同时：→Q2=1→产生CP1→使FF1触发翻转→控制换向。Q2Q2’参考电路(1)(2)FF1FF2CP1CPD25.当8个灯被熄灭后(D2=0)，下个CP来时→Q2=0，使CP1回到0态。→Q2’=1，释放74LS194的清0端，使之可以移位。以后，每来一个CP，等按新的方向逐个点亮。Q2Q2’波形实验报告回答问题：1.画输出波形（需包含19个CP）。2.如cp1到来

3、使第一个灯亮，并说明CP8、CP9、CP10、CP11时电路的工作状态。预习报告要求：1.设计电路。2.简述工作原理。11189101918⑵4位串行加法电路设计194(1):被加数，低位串出。194(2):加数，低位串出。194(3):最终和，高位串入。∑:1位全加器，进行1位加法。D:寄存本位进位，使之参与高位相加。被加数和加数设置如执行：6＋7第1拍:置数置数⑴=0110⑵=0111+001⑶=0000⑴=0011⑵=0011+010⑶=1000第2拍:右移右移⑴=0110⑵=0111+001⑶=0000第1拍:置数⑴=0011⑵=0011+010

4、⑶=1000第3拍:右移右移⑴=0110⑵=0111+001⑶=0000第1拍:置数第2拍:右移⑴=0001⑵=0001+111⑶=0100低位进位经D锁存参与相加。低位进位经D锁存参与相加。⑴=0011⑵=0011+010⑶=1000第4拍:右移右移⑴=0110⑵=0111+001⑶=0000第1拍:置数第2拍:右移⑴=0001⑵=0001+111⑶=0100第3拍:右移⑴=0000⑵=0000+101⑶=1010⑴=0011⑵=0011+010⑶=1000第5拍:右移右移⑴=0110⑵=0111+001⑶=0000第1拍:置数第2拍:右移⑴=0001

5、⑵=0001+111⑶=0100第3拍:右移⑴=0000⑵=0000+101⑶=1010第4拍:右移⑴=0000⑵=0000+000⑶=11015拍后完成运算有关向高位的进位：如进行13＋6运算：1101＋0110＝10011第5拍之后：最终和：0011在194(3)中；向高位的进位可从D的Q端（或194(3)的SR端）取得。向高位的进位可以用开关进行被加数和加数的设置。实验六预习要求任务：集成计数器及其应用⑴设计24进制、60进制计数电路⑵设计12归1计数设计选用器件:74LS290（2-5-10计数器）74LS161（16进制计数器）门电路24进制参

6、考电路QD2QC2QB2QA2QD1QC1QB1QA1=0010010060进制参考电路QD2QC2QB2QA2QD1QC1QB1QA1=0101100110010101讨论60进制1001010112归1计数器设计要求：用2位十进制数BCD码表示计数状态。计数状态：十位个位000000010000001000000011000001000000010100000110000001110000100000001001000100000001000100010010十位个位000010001000011001000010100110001110100001

7、001100001000110010或者译码电路74LS48×212归1计数器十进制计数便于译码显示输出。290：2－5－10异步计数器异步清0，异步置数。1、用74LS290实现12归1Q3Q2Q1Q0CP2CP1RO1RO2SO1SO2二进制五进制组成十进制也可组成十进制Q3Q2Q1Q0CP2CP1RO1RO2SO1SO2二进制五进制290（1）290（2）1→0CP入CP1Q0二进制CP2Q3Q2Q1五进制CP1Q0二进制③当Q21Q18Q14Q12Q11=10011时,(2)片清0、(1)片保持不变，仍为1,结果使Q21Q18Q14Q12Q11=

8、00001，实现12归1的计数。②当Q18Q14Q12Q11组由1001→000