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1、QuartusII用户指南©2001Altera®Corporation1设计描述设计输入设计修改设计编译功能确认命令行模式脚本延时确认器件编程在线确认生产©2001Altera®Corporation2设计输入!多种设计输入方法–QuartusII•原理图式图形设计输入•文本编辑–AHDL,VHDL,Verilog•内存编辑–Hex,Mif–第三方工具•EDIF•HDL•VQM–或采用一些别的方法去优化和提高输入的灵活性:•混合设计格式•利用LPM和宏功能模块来加速设计输入©2001Altera®Corporation3设计输入文件Q
2、uartusIIQuartusIIQuartusII模块编辑文本编辑内存编辑VerilogMegaWizard®VHDLManagerExemplar,Synopsys,顶层文件的扩展名可以AHDL顶层Synplicity,是：bdf,.tdf,.vhd,文件etc....vhdl,.v,.vlg,.edifor原理图.edf原理图.v,.vlg,.edf.bdf.bsf.tdf.vhd.v.vhd,.vhdl,.edif.gdfvqmBlockSymbolTextTextTextTextText文件文件文件文件文件文件文件由Quart
3、usII产生从第三方工具输入©2001Altera®Corporation4图表和原理图编辑器该编辑器既可以编辑图表模块，又可以编辑原理图!图表模块编辑是主要的顶层设计的主要方法!原理图编辑是传统的设计输入方法!用户可以利用加入QuartusII提供的LPMs，宏功能等涵数以及用户自己的库涵数来设计!提供“智能”的模块链接和映射©2001Altera®Corporation5图表模块–设计流程!产生一个新的模块设计文件–画出图表模块或输入设计单元符号–输入接口和参数信息–连接各个设计单元(利用单连线，总线等)!保存设计–文件的后缀名为.
4、bdf!顶层模块可以是用户产生的HDL文件或图形编辑文件!从顶层设计可以产生设计单元，头文件，或转化成Verilog/VHDL文件©2001Altera®Corporation6模块编辑器–产生一个新的文件!产生一个新的图表模块/原理图文件菜单:File>New>Block/Schematicdocument新建一个新的文件选择模块/原理图文档©2001Altera®Corporation7模块编辑器-设计模块!从工具栏中产生模块和输入端口点击工具栏中的“模块”来画一个图表右键点击模块。选择属性，从弹出的对话框中输入端口信息。©2001
5、Altera®Corporation8模块编辑器-“智能”连接!QuartusII有“智能”模块连接和映射–如果连接不同模块时，两边端口的名字相同的话就不用标注出来–一个管道可以连接模块之间所有的普通I/O映射连接©2001Altera®Corporation9模块编辑器-产生设计文件!给模块定义并产生HDL或图形设计文件右键点击，弹出对话框从菜单中选选择格式择产生设计AHDL,文件VHDL,Verilog，Graphic©2001Altera®Corporation10支持的第三方工具综合工具仿真工具LeonardoSpectrum*
6、•ModelSim*DesignCompiler•ModelSimOEM*FPGACompilerIIStandard*&•CadenceVerilog-XLAlteraEdition*•InnovedaBLASTFPGAExpress*•PrimeTime*SynplicitySynplify*•SynopsysVCS•SynopsysVSS注意*表示支持内部链接©2001Altera®Corporation11QuartusII驱动流程Project>EDAToolSettings...当选择内部链接的EDA工具，会自动产生ATOM
7、网表，并且会自动选择数据格式QuartusII驱动流程©2001Altera®Corporation12EDA驱动流程EDA工具驱动QuartusII©2001Altera®Corporation13文件驱动流程:非内部链接如果用一个非内部链接的EDA工具产生VHDL,Verilog,EDIF文件,就需要阐明.lmf文件来给定文件格式可以是EDIF,VHDL,orVerilog菜单Project>EDATool选择自定义Settings...选择库涵数映射文选择设置...件(lmf)©2001Altera®Corporation14新建
8、项目指南1.打开新建项目指南2.选择工作目录3.项目名称，可以是任何名字。推荐使用和顶层设计名相同的名字.4.顶层设计.名字必须和顶层文件名字相同©2001Altera®Corporation15新建项目指
