表征高速高密度背板中的串扰效应

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1、CharacterizingCrosstalkCENTELLAX表征高速高密度背板中的串扰效应WilliamSitchCentellax,Inc.August2010AN24摘要本文概述了串扰的不利影响，对比分析了串扰测量的几种方法，并详细介绍了高密度高速背板上串扰的鉴定方法。使用了基于误码率的抖动测量方法来量化近端串扰、远端串扰以及干扰信号源的相位扫描时引入的抖动。内容串扰的定义.....................................................................................................

2、.................2串扰的仿真...................................................................................................................2串扰的测量...................................................................................................................3在频域测量串扰引入的信号.....................

3、.................................................................3在时域测量串扰引入的信号......................................................................................5在时域测量被干扰通道的抖动...................................................................................6表征AdvancedTCA背板的串扰.............

4、..........................................................................8背板与测试环境............................................................................................................9测试仪器(PCB12500)........................................................................................

5、........12测量结果....................................................................................................................13参考文献........................................................................................................................15CENTELLAX·http://www.centellax.com/

6、·sales@centellax.com·866.522.6888iSpecificationssubjecttochangewithoutnotice.Copyright©2001-2010Centellax,Inc.PrintedinUSA.Sep2010CharacterizingCrosstalkCENTELLAX串扰的定义串扰是某一个数据或时钟信号的部分能量耦合到了另一电路或系统。串扰是由容性耦合或感性耦合的电磁场引起的模拟信号的干扰。在任何复杂的三维结构上高密度的高速信号布线都容易产生串扰，这会导致以下信号完整性问题：ò噪声增加（降低了信噪比SNR）ò增加了数据边沿的

7、抖动（减少了器件的规范要求的余量）ò无用信号的反射（减小信号检测器的灵敏度）优化设计可以减轻串扰的影响。增大信号和时钟线之间的物理间距，减小并行走线的长度，使用更多的地平面的多层板、使用差分信号都可以减小串扰。遗憾的是，当前更小的设备上有更多的数据和时钟线，这些优化设计方法的作用是有限的。要有效的减小串扰，需要结合良好的布局设计与工程实践经验，必要时，在生产线中进行相关测试，以确保制造公差导致的变化足够小。串扰的仿真最近，电路仿真工具在分析电路性能上有很大进展，但是仿真串扰的能力