数字钟-实验报告

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1、57电子科技大学实验报告学生姓名：学号：指导教师：冯健实验地点：科研楼B座453实验时间：2008.3.18一、实验室名称：二、实验项目名称：数字钟的FPGA设计与实现三、实验学时：16学时四、实验原理：数字钟电路的基本结构(图1所示)由两个6O进制计数器和一个24进制计数器组成，分别对秒、分、小时进行计时，当计时到23时59分59秒时，再来一个计数脉冲，则计数器清零，重新开始计时。六十进制计数器系统时钟秒计数器数据选择器六十进制计数器译码器显示码数码管数码管数码管秒分时秒脉冲分脉冲时脉冲BCD码BCD码BCD码扫描码产生图1实现方案电路框图秒计数

2、器的计数时钟clk为1Hz的标准信号，可以由晶振产生的信号通过分频得到。当数字钟处于计时状态时，秒计数器的进位输出信号carry作为分钟计数器的计数信号，分钟计数器的进位输出信号carry又作为小时计数器的计数信号。时、分、秒的计时结果通过6个数码管来动态显示。一、实验目的：1.掌握计数器的基本设计方法；2.对利用VHDL硬件描述语言设计相关模块有一定的了解;3.ALTERAMAXPLUSII软件的使用。4.要求：能够自动计时，并下载到实验箱中用七段数码管显示出时、分、秒一、实验内容：1.在MAX+PLUSII软件上用VHDL语言编写源程序实现数字

3、钟的五个模块。2.将所编程序进行编译并调试改错，最终实现正确仿真。3.选择芯片型号：Device→FLEX10K→EPF10K10LC84-44.管脚分配:Programmer→FloorplanEditor5.将实验箱中的管脚按照芯片管脚分配好。6.编译适配：Complier7.启动Programmer→HardwareType→Byteblaster→Ok8.JTAGMulti-DeviceJTAGChain选择要下载的文件：XXX.pof→Add→Ok9.Programmer→Configure二、实验器材（设备、元器件）1.EDA实验箱一

4、只2.MAXPLUSⅡ软件一套三、实验步骤：1.分别建立模块源程序。运行MAXPLUSII软件，首先选择“File”中的“New”,建立一个新的VHDL文件；编辑VHDL源程序选择“TextEditorfile”。输入五个模块的源程序，将源程序存为VHDL文件格式，分别进行编译。2.分别建立模块仿真文件 ，仿真源文件。首先，选择“File→New”,建立一个新的仿真文件。选择“WaveformEditorfile”，并选择文件扩展名为“.scf”，得到仿真波形窗口。添加仿真波形名称：点击“Node→EnterNodesfromSNF…”，出现仿真波

5、形窗口；点击右上方“List”，左边窗口显示全部信号名称，将待仿真的信号添加到右边窗口；点击“OK”。然后，设置仿真波形文件为当前工程：选择“File→Project→SetProjecttoCurrentFile”；保存，选择正在使用的“驱动器→目录”，输入文件名“.scf”点击“OK”。最后，编辑输入信号：点击输入信号名称，利用左边工具栏编辑输入的激励信号，点击“MAX+plusII→Simulator→Start”进行仿真。3．采用原理图方式GraphicEditorfile(*.gdf),将这五个模块连接起来，这是最方便，最直观的逻辑输入方

6、法。输入逻辑元件，没有的逻辑元件，如输入输出可在SymbolLibraries框中选择prim库,在SymbolName栏输入input或者output。设计好的原理图如图2所示：图2数字钟电路图4.整体编译。上面已经完成了原理图的输入，需要给设计指定一个工程名，选择File->Project->SetProjecttoCurrentFile，将当前工程名设为当前文件名。准备开始编译，选择MAX+plusII->Compiler，弹出编译窗口，按Start开始编译。如图3所示：图3整体编译窗口编译结束之后，在正确无误的情况下可以进行下一步的仿真5.

7、整体仿真。首先要编辑一个波形文件，打开MAX+plusII->WaveformEditor：图4波形仿真界面然后确定仿真的时长，选择File->EndTime，输入100us，确定；还需要确定仿真的最小时间单位，选择Option->GridSize，输入50ns，确定；下面开始输入要仿真的信号名称，选择Node->EnterNodeFromSNF，按=>选择要增加的Nodes，点击输入信号名称，利用左边工具栏编辑输入的激励信号，点击“MAX+plusII→Simulator→Start”进行仿真。6.选择芯片型号：Device→FLEX10K→EP

8、F10K10LC84-47.管脚分配:Programmer→FloorplanEditor8.将实验箱中的管脚按照芯片管脚