《数字电子计数器》PPT课件

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1、第五章计数器引入:电路中由两个与非门构成单脉冲发生器，计数器74LS161对其产生的脉冲进行计数，计数结果送入字符译码器并驱动数码管，使之显示单脉冲发生器产生的脉冲个数。脉冲发生器计数器显示010101010CPQ1Q2QQ00000101001011111图5.2（b）计数器各触发器的翻转不受同一个CP脉冲控制。——异步计数器计数器各触发器的翻转受同一个CP脉冲控制。——同步计数器Q0Q1Q21.计数器的基本原理5.1计数器及其表示方法2.分类▲根据计数脉冲的输入方式不同可把计数器分为同步计数器和异步计数

2、器。▲根据计数进制不同又可分为二进制、十进制和任意进制计数器。▲根据计数过程中计数的增减不同又分为加法计数、减法和可逆计数器。3.二进制计数器若n=1，2，3…，则N=2，4，8…，相应的计数器称为模2计数器，模4计数器和模8计数器。计数器的位数n：即由多少个触发器组成。（n）计数器的模（计数容量）：最大所能计数的值N=2n三位二进制计数器同步二进制计数器——74LS161集成计数器（2）74LS161功能表输入输出ETEPCPD0D1D2D3Q0Q1Q2Q30××××××××10××↑d0d1d2d311

3、11↑××××110××××××11×0×××××0000d0d1d2d3计数保持保持（1）各引脚功能符号的意义：D0~D3：并行数据预置输入端Q0~Q3：数据输出端ET、EP：计数控制端CP：时钟脉冲输入端（↑）C：进位端：异步清除控制端（低电平有效）：置数控制端（低电平有效）74LS161状态图注释74LS161是典型的4位二进制同步加法计数器，异步清除。同于74161。请问它的模是几？◆、、ET和EP均为高电平时，计数器处于计数状态，每输入一个CP脉冲，进行一次加法计数。（3）74LS161的功能与特

4、点◆：异步置“0”功能。波形图00001010◆ET和EP是计数器控制端，其中一个为低电平，计数器保持原态。两者均为高电平，计数器才处于计数状态。◆：同步并行置数控制端（低电平有效），=0，且=1时，D0~D3上数据被输出到Q0~Q3。◆、、ET和EP均为高电平时，计数器处于计数状态，每输入一个CP脉冲，进行一次加法计数。异步二进制计数器——74LS93集成计数器74LS93是异步4位二进制加法计数器。图5.6（b）二进制计数器：CP0作同步脉冲，FF0构成一个二进制计数器;八进制计数器：CP1作同步脉冲

5、，FF1、FF2、FF3构成模8计数器;十六进制计数器：CP1端与Q0端在外部相连，构成模16计数器。74LS93又称为二—八—十六进制计数器。RD1、RD2为清零端，高电平有效。4.十进制计数器同步十进制计数器——74LS192集成计数器▲逻辑符号输入输出RDCUCDD0D1D2D3Q0Q1Q2Q300××d0d1d2d310↑1××××101↑××××1011×××××1××××××d0d1d2d3加计数减计数保持0000▲74LS192功能表各引脚功能符号的意义：D0~D3：并行数据输入端Q0~Q3：

6、数据输出端CU：加法计数脉冲输入端CD：减法计数脉冲输入端RD：异步置0端（高电平有效）：置数控制端（低电平有效）：加法计数时，进位输出端（低电平有效）：减法计数时，借位输出端（低电平有效）▲74LS192的时序图分析RD：异步置0端。计数器复位。置零0000：置数控制端（低电平有效）。1110CD为高电平，计数脉冲从CU端输入。:进位输出;:借位输出。CU为高电平，计数脉冲从CD端输入。1001000000001001计数开始时，先在RD端输入一个正脉冲，此时两个计数器均被置为0状态。此后在端输入“1”，

7、RD端输入“0”，则计数器处于计数状态。在个位的74LS192(1)的CU端逐个输入计数脉冲CP，个位的74LS192开始进行加法计数。在第10个CP脉冲上升沿到来后，个位74LS192的状态从1001→0000，同时其进位输出从0→1。▲利用74LS192实现100进制计数器(想一想)将多个74LS192级联可以构成高位计数器。例如：用两个74LS192可以组成100进制计数器。此上升沿使十位的74LS192(2)从0000开始计数，直到第100个CP脉冲作用后，计数器由10011001恢复为000000

8、00，完成一次计数循环。▲逻辑符号▲74LS90功能表复位/置位输入输出RD1RD2S1S2Q3Q2Q1Q011×0×0×11××0×00×10××0×01×00×000000001001计数计数计数计数RD1RD2：当S1S2=0时，RD1RD2=1计数器清零。S1、S2：S1S2=1时，计数器置“9”，即被置成1001状态，与CP无关。且优先级别最高。Q3Q2Q1Q0：输出端▲引脚功能说明CP0、CP1：双时