“DSP技术”第2章内部资源介绍

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1、小测验1）DSP的基本特点2）什么是哈佛结构?（并画出示意图）3）DSP与单片机的主要区别第2章：TMS320LF240xDSP内部资源介绍2.1TMS320LF240xDSP的CPU内部功能模块介绍2.2存储器和I/O空间2.3系统配置和中断2.4程序控制第2章：TMS320LF240xDSP内部资源介绍重点：TMS320LF240xDSPCPU控制器的内部功能模块；存储器和I/O空间；系统配置和中断；程序控制工作原理难点：）DSP2407的中断系统（2）DSP2407的存储器映射（3）DSP2407锁相环的工作方式（4）DSP2407数字I/O引脚的使用R2的理解

2、2.1TMS320LF240xDSP的CPU内部功能模块介绍中央处理单元(CPU)输入定标器乘法单元中央算术逻辑单元2.1TMS320LF240xDSP的CPU内部功能模块介绍1、输入定标移位器是一个16位到32位的滚动式左向移位器；能将输入的16位数据的0～15位在本周期内向左移位以得到32位的输出；本操作不需要额外的周期。2.1TMS320LF240xDSP的CPU内部功能模块介绍移位器的输入来源数据读总线(DRDB)，该输入值来自指令操作数据所引用的数据存储单元；程序读总线(PRDB),改输入是指令操作数给出的常数。移位量的来源嵌在指令字中的常数。把移位量放在指

3、令字中，该程序代码使用特定的数据比例；临时寄存器TREG的提位。根据TREG的值移位，数据的定标因子是动态确定的，可适应不同的系统要求。2.1TMS320LF240xDSP的CPU内部功能模块介绍输入移位器的输出值最低有效位LSBs段填0；未使用的最高有效位MSBs填0或者根据状态寄存器ST1的SXM位的值来确定是否需要进行符号扩展2.1TMS320LF240xDSP的CPU内部功能模块介绍2、乘法器16×16位的硬件乘法器，在单个周期内产生一个32位乘积结果的有符号或无符号数；除了MPYU指令，所有的乘法指令都执行有符号的乘法操作。2.1TMS320LF240xDS

4、P的CPU内部功能模块介绍乘法器的输入16位临时寄存器(TREG)，在乘法之前把数据读总线的值加载到TREG；数据读总线的数据存储器值和程序读总线的程序存储器值。乘法器的输出两个输入值相乘后的32位结果保存在乘积寄存器(PREG)中；PREG的输出连接到32位的乘积定标移位器(PSCALE)，通过PSCALE将乘积结果送到CALU或数据存储器。2.1TMS320LF240xDSP的CPU内部功能模块介绍乘法定标移位器(PSCALE)输入：该移位器的32位输入连到PREG的输出。输出：完成移位后，全部32位送到CALU，或将结果的16位存到数据存储器。移位模式：该移位器

5、可用4中移位模式，这些模式由状态寄存器ST1的乘积移位方式(PM)位确定。注：PREG的内容保持不变，其值被复制到PSCALE中，进行移位。PM移位说明00不移位乘积结果没有移位地送到CALU单元或数据总线01左移1位移去在一次2的补码乘法运算中产生的1位附加符号位，以得到一个Q31的乘积10左移4位当与一个13位的常数相乘时，移去在16×13位的2的补码乘法运算中产生的4位附加符号位，以生成一个Q31的乘积11右移6位对乘积结果进行定标，以使得运行128次的乘积累加器不会溢出2.1TMS320LF240xDSP的CPU内部功能模块介绍乘法器相关指令及操作用LT指令将

6、数据从数据总线载入TREG提供1操作数，MPY指令提供第2个操作数或从数据总线上得到。使用MPY指令时，可以对一个13位的立即数进行操作，每两个指令周期得到一个乘积。代码执行多路乘法和乘积求和运算时，CPU支持流水线操作。指令操作LT把通过CALU得到的前次乘积结果装载到TREGLTP把PREG的值装载入ACCLTA把PREG的值加载到ACCDMOV,LTD把PREG的值加到ACC，移位TREG输入数据到数据存储器的下一地址LTS从ACC中减去PREG的值2.1TMS320LF240xDSP的CPU内部功能模块介绍乘法器相关指令及操作乘且累加并带动数据移动指令MAC和

7、MACD充分利用了乘法器的计算宽度，允许两个操作数被同时处理。无符号乘法运算MPYU指令执行大大方便了用于扩展精度的算术运算。平行并累加前次乘积指令SQRA和平方并减去前次乘积指令SQRS传送相同的数到乘法器的两个输入端，以对一个数据存储器单元的值进行平方运算。存储乘积的高字节指令SPH和低字节指令SPL，可将装入PREG的32位乘积结果传送到CALU单元或数据存储器。在执行中断服务程序前必须对PREG的值进行保存。2.1TMS320LF240xDSP的CPU内部功能模块介绍3、中央算术逻辑部分中央算术逻辑单元(CALU)：实现各种算术、逻辑功能；3