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1、word格式整理版摘要本设计为一个多功能的数字时钟，具有时、分、秒计数显示功能，以24小时循环计数；具有校对功能。本设计采用EDA技术，以硬件描述语言VerilogHDL为系统逻辑描述语言设计文件，在QUARTUSII工具软件环境下，采用自顶向下的设计方法，由各个基本模块共同构建了一个基于FPGA的数字钟。系统由时钟模块、控制模块、计时模块、数据译码模块、显示以及组成。经编译和仿真所设计的程序，在可编程逻辑器件上下载验证，本系统能够完成时、分、秒的分别显示，按键进行校准，整点报时，闹钟功能。关键词：数字时钟，硬件描述语言，VerilogHDL，FPGA学习参考word格式整理版Abstrac
2、tThedesignforamulti-functionaldigitalclock,withhours,minutesandsecondscountdisplaytoa24-hourcyclecount;haveprooffunctionsfunction.TheuseofEDAdesigntechnology,hardware-descriptionlanguageVHDLdescriptionlogicmeansforthesystemdesigndocuments,inQUAETUSIItoolsenvironment,atop-downdesign,bythevariousmodu
3、lestogetherbuildaFPGA-baseddigitalclock.Themainsystemmakeupoftheclockmodule,controlmodule,timemodule,datadecodingmodule,displayandbroadcastmodule.Aftercompilingthedesignandsimulationprocedures,theprogrammablelogicdevicetodownloadverification,thesystemcancompletethehours,minutesandsecondsrespectivel
4、y,usingkeystocleared,tocalibratingtime.Andontimealarmandclockfordigitalclock.Keywords：digitalclock,hardwaredescriptionlanguage,VerilogHDL,FPGA学习参考word格式整理版目录摘要1Abstract2第一章绪论11.1.选题意义与研究现状11.2.国内外研究及趋势11.3.论文结构2第二章编程软件及语言介绍32.1QuartersII编程环境介绍32.1.1菜单栏32.1.2工具栏82.1.3功能仿真流程92.2VerilogHDL语言介102.2.1什么
5、是verilogHDL语言102.2.2主要功能11第三章数字化时钟系统硬件设计133.1系统核心板电路分析133.2系统主板电路分析153.2.1时钟模块电路153.2.2显示电路153.2.3键盘控制电路173.2.4蜂鸣电路设计17第四章数字化时钟系统软件设计184.1整体方案介绍184.1.1整体设计描述184.1.2整体信号定义194.1.3模块框图204.2分频模块实现204.2.1分频模块描述20学习参考word格式整理版4.2.2分频模块设计204.2.3分频模块仿真214.3计时模块实现214.3.1计时模块描述与实现214.3.2计时模块仿真234.4按键处理模块实现23
6、4.4.1按键处理模块描述234.4.2按键去抖处理模块设计244.4.3按键模块去抖仿真244.5闹钟模块实现254.5.1闹钟模块设计254.5.2闹钟设定模块仿真254.6蜂鸣器模块实现254.6.1蜂鸣器模块描述254.6.2蜂鸣器模块实现264.6.3蜂鸣器模块仿真274.7显示模块实现274.7.1显示模块描述274.7.2显示模块实现274.7.3显示模块仿真29第五章系统调试及运行结果分析305.1硬件调试305.2软件调试315.3调试过程及结果315.4调试注意事项33第六章总结和展望345.5总结34学习参考word格式整理版5.6展望34参考文献35致谢36附录37第
7、一章学习参考word格式整理版第一章绪论1.1.选题意义与研究现状在这个时间就是金钱的年代里，数字电子钟已成为人们生活中的必需品。目前应用的数字钟不仅可以实现对年、月、日、时、分、秒的数字显示，还能实现对电子钟所在地点的温度显示和智能闹钟功能，广泛应用于车站、医院、机场、码头、厕所等公共场所的时间显示。随着现场可编程门阵列(fieldprogram-mablegatearray，FPGA)的出现，电子系统向集
