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时间:2019-03-21
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1、穀4去如成AfAI硕±学位论文MASTERTHESIS'/JBi气巍V^m心"^-麵通■曜■I■论文题■目高速采样中的低抖动时钟源的妍究与实现学科专业通信与信息系统201321010226学号作者姓名鲁凌菁指导教师朱学勇教授V.。:.:;.、…I::^.cv::’s::…:分类号密级注1UDC学位论文高速采样中的低抖动时钟源的研究与实现(题名和副题名)鲁凌菁(作者姓名)指导教师朱学勇教授电子科技大学成都(姓名、职称、单位
2、名称)申请学位级别硕士学科专业通信与信息系统提交论文日期2016.03论文答辩日期2016.05学位授予单位和日期电子科技大学2016年06月答辩委员会主席评阅人注1:注明《国际十进分类法UDC》的类号。FREQUENCYSOURCEDESIGNBASEDONFMCWRADRSYSTEMMasterThesisSubmittedtoUniversityofElectronicScienceandTechnologyofChinaMajor:InformationandcommunicationengineeringAuthor:LuLingjingA
3、dvisor:Prof.ZhuXueyongSchool:SchoolofCommunication&InformationEngineering独剑性声明本人声明所呈交的学位论文是本人在导师指导下进行的研究工作。及取得的研究成果据我所知,除了文中特别加标注和致谢的地方夕h,论文中不包含其他人已经发表或撰写过的研究成果,也不包含为获得电子科技大学或其它教育机构的学位或证书而使用过的材料。与我一同工作的同志对本研究所做的任何贡献均已在论文中作了明确的说明并表不谢意。來養:訂乂年r月么作者签名;據日期日论文使用授权
4、本学位论文作者完全了解电子科技大学有关保留、使用学位论文,的规定,有权保留并向国家有关部口或机构送交论文的复印件和磁盘允许论文被查阅和借阅。本人授权电子科技大学可将学位论文的全部或部分内容编入有关数据库进行检索,可W采用影印、缩印或扫描等复制手段保存、汇编学位论文。(保密的学位论文在解密后应遵守此规定)1/&:作者签名:导师签名名4韦J曰期;公f(年方月八曰摘要摘要采样,是将模拟信号转换为数字信号的一种必然的手段,也为信息的后续处理提供了可能性。随着社会的发展,各种技术也在不断创新,人们对于采样速率的要求也越
5、来越高,而高速采样系统的也给时钟的精准性也提出了更高的要求。在现代采样系统中,一个好的时钟源,可能是这个系统的基石;若时钟源本身性能较差,会给被采样信号带来更多的误差,那么采样过来的信号就没有分析的必要。衡量一个时钟源的关键性指标就是相位抖动(频域上表现为相位噪声),因此实现一个低抖动的时钟源是十分有意义的。本文是基于实际项目“高速采样系统”对时钟源的抖动特征进行研究的;而且采样系统的采样时钟,要求频率连续可变,即频率分辨率要做到很小。而直接数字合成(DDS)有两个突出的特点:一是捷变频;二是频率步进小,即频率分辨率高,可以满足项目中所要求的频率连续
6、可变,因此选择DDS作为时钟源研究电路。但DDS会产生较多的频率分量,即杂散较多,频谱纯度不好,所以需要研究怎么去除杂散,尤其是DDS输出的近端无法滤除的杂散。理论分析了相位噪声和DDS谐波杂散对时钟源输出的抖动特征的影响,并对其相位噪声和谐波杂散建模,更加直观的观测到它们对时钟源输出时钟和抖动特征的影响;随后提出了一个去除带内近端杂散的方案,以此来减小时钟抖动;并依据此原理,设计一款低抖动的时钟源。下面是本文的主要研究内容:1、理论分析相位噪声和谐波杂散对时钟抖动特征的影响,从理论上分析降低抖动的可能性;随后给出去除最差杂散的方案,并从理论上分析它
7、的可行性。2、设计低抖动时钟源的实现方案,分析其合理性;并给出基于AD9912的电路设计,和SpurKiller的配置。3、对实现的时钟源电路进行测试,包括产生不同频率的时钟功能测试和相噪、抖动的性能测量,并在配置了SpurKiller之后,降低了时钟源的相位噪声、时间抖动。关键词:时钟源,低抖动,DDS,去杂散(SpurKiller),相位噪声IABSTRACTABSTRACTSampling,isanecessarywaytoachievethetransformationfromanalogsignaltodigitalsignal,makes
8、itpossibletodealwiththesignallaterwithcomputerorothert
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