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时间:2019-03-21
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1、i円游姑带M專圓硕±学位论文§圍.^、麵圆一*1基于UVM的UART验证环境开发1^作者姓名夏腐尝11学校导臟名、职砍吴振宇融教授^企业导雌名、职琼朱思良高工申请学位类别工麵+学校代码10701学号1311122937分类号TN4密级公开西安电子科技大学硕±学位论文基于UVM的UART验证环境开发作者姓名:夏晓芸领域:软件工程学位类别:工程硕壬学校导师姓名、职称:吴镇宇副教授企业导师姓名、职称:朱思良高工学院:微电子
2、学院提交日期:2015年12月UARTENVIRONMENTRESEARCHANDDEVELOPMENTBASEDONUVMARCHITECTUREAthesissubmittedtoXIDIANUNIVERSITYinpartialfulfillmentoftherequirementsforthedegreeofMasterinSoftwareEngineeringByXiaxiaoyunSupervisor:WuzhenyuAssociateProfessorZhusiliangSeniorEngineerDecem
3、ber2015西安电子科技大学学位论文独创性(或创新性)声明秉承学校严谨的学风和优良的科学道德,本人声明所呈交的论文是我个人在导师指导下进行的研究工作及取得的研究成果。尽我所知,除了文中特别加W标注和致谢,论文中不包含其他人已经发表或撰写过的研究成果中所罗列的内容W外;也不包含为获得西安电子科技大学或其它教育机构的学位或证书而使用过的材料一。与我同工作的同事对本研巧所做的任何贡献均已在论文中作了明确的说明并表示了谢意。学位论文若有不实之处一,本人承担切法律责任。本人签名:I媒4日期:西安
4、电子科技大学关于论文使用授权的说明目;本人完全了解西安电子科技大学有关保留和使用学位论文的规定,P研究生在校攻读学位期间论文工作的知识产权属于西安电子科技大学。学校有权保留送交论文的复印件,允许查阅、借阅论文,;学校可公布论文的全部或部分内容允许采用影印、缩印或其它复制手段保存论文。同时本人保证,结合学位论文研究成果完成的论文、发明专利等成果,署名单位为西安电子科技大学。保密的学位论文在年解密后适用本授权书。_献龙卡:豕本人签名:\导师签名廣聋)心^,..-71与日期;Z日
5、期;)i摘要摘要随着集成电路已经进入后摩尔时代,电路的复杂性日益提高,因此验证工作的难度也越来越高,随着验证要求的提高,在实际生产中,传统的直接验证已经越来越难以满足设计的需求。为了使产品更加具有竞争力,在激烈的市场竞争中获取有利地位,在确保功能正确的前提下,提高代码复用率,缩短验证周期成了各个公司缩短产品上市周期的重要方法。为此,就需要采用更有效的验证方法,使得验证工作更加有效。在市场的驱动下,验证工作日益成熟,渐渐独成一体。基于SystemVerilog的UVM验证具有很高的抽象性,可以通过产生受约束的随机激励来提高代码覆
6、盖率,使得验证效率大大提高。此外,由于UVM各个模块功能划分明确,使得各个模块具有一定的独立性,这样可以很好的提高代码复用率,从而在长远上,大大缩短后期新开发的产品上市周期。由于以上各项优点,基于SystemVerilog的UVM验证已经成为多家IC公司验证的主流,并且还在不断发展。本文的验证对象是在华虹集成电路有限责任公司实习时所参加的TPCM项目中的一款MCU中的由公司设计人员自主设计的UART(通用异步收发传输器)模块。此款UART是在通用UART的基本功能上加以增强而来的,相对于通用UART,多了多机通讯以及错误位检测功能
7、,并且多了模式0,在数据帧结构上有所不同。通过对UVM验证平台的基本组成,常用的标准库进行学习研究,并对各个组成模块的功能以及各个模块间的联系进行分析研究,利用UVM验证方法学,搭建适合UART验证的环境,并且为后期系统级验证做准备,在搭建验证平台时采用AMBA2.0总线架构,虽然这会增加验证平台的搭建难度,但是提高了代码复用率,是本文的重点。通过对UART功能进行研究分析,分析UART的工作特点,利用UVM验证方法学的特点,由Sequence模块产生相应的受约束的随机激励,通过Monitor模块监视需要验证的UART模块的输出,
8、并且由Scoreboard模块进行结果自动比较。在验证平台搭建完成后,为了排除由于验证环境的问题而导致的结果不正确,需要对验证平台进行调试。在这之后,加入待验证的UART。为了确保验证结果的正确性,对于最后的输出波形,选取具有代表性的波形进行分析。
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