ddr存储系统访存性能的解析建模与验证

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2、评阅人王举香曲巧巧巧祖化ｇ工２０１６年５月３１日？素兩：ｋ參工程硕±学位论文ＤＤＲ存储系统访存性能的解析建模与验证专业名称：歉件工超研究生姓名：郑晓巧导师姓名：吴建辉教授虔建立髙工ＡＮＡＬＹＴＩＣＡＬＭＯＤＥＬＩＮＧＡＮＤＶＡＬＩＤＡＴＩＯＮＦＯ民ＡＣＣＥＳＳＰＥＲＦＯＲＭＡＮＣＥＯＦＤＤ民ＭＥＭＯＲＹＳＹＳＴＥＭＡＴｈｅｓｉｓＳｕｂｍｉｔｅｄ化ＳｏｕｔｈｅａｓｔＵｎｉｖｅｒｓｉｔｙＦｏｒｔｈｅＡｃａｄｅｍｉｃＤｅｇｒｅｅｏｆＭａｓｔｅｒｏｆＥ

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4、我同工作的同志对本研究所做的任何贡献均己在论文中作了明确的说明并表示了谢意。研究生签名：ｉ嵌／呵曰期：卑＾司Ｉ曰ｆ东南大学学位论文使用巧化声明东南大学、中国科学技术信息研巧所、国家图书馆有权保留本人所送交学位论文的复印件和电子文档，可Ｗ采用影印、缩印或其他复制手段保存论文。本人一致电子文档的内容和纸质论文的内容相。除在保密期内的保密论文外，允许论文被查阅和借阅，可Ｗ公布（包括刊登）论文的全部或部分内容。论文的公布（包括刊登）授权东南大学研巧生院办理。研究生签名：為於；导师签名：义寺曰期心日Ｉ日§５摘要随

5、着处理技术的大规模进步，ＳｏＣ系统对片上存储器延时和带宽的要求越来越髙，坦样一来存储系统成为了主要的性能限制瓶颈，。面临复杂的存储系统设计时传统的仿真模型建模过程复杂，仿真速度慢，己经无法满足需求。提高系统设计的抽象层次，系统级设计成为解决问题的必要方案。利用数学方法建立解析建模对存储系统进行研巧，可Ｗ量化分析影响存储系统性能的因素，并大大减少了性能评估验证时间，具有灵活性髙、仿真速度快的特点。本文主要针对ＤＤＲ存储系统进行富层性能评估，重点研巧ＤＤＲ存储系统的访存延时，对其进行解析建模并评估性能和带宽。现存的存储系统访存延时解析

6、建模未能全面分析访存请求流程，导致得到的访存延时误差较大。本文根据访存请求服务流程全面分析ＤＤＲ存储系统的访存延时，充分考虑访存延时的组成成分，将访存延时分为ＤＤＲ存储控制器延时和ＤＤＲ存储器延时两个部分进行建模。ＤＤＲ存储控制器延时的主要成分是访存请求的排队延时，本文根据排队模型的输入过程、排队规则和服务机制兰大特性建立了存储系统访存请求的Ｍ／Ｄ／１排队模型来进行性能分析。根据ＤＤＲ访存请求的访存模态，即行缓冲命中和行缓冲未命中评估存储器服务时间和ＤＤＲ存储器延时，最终建立了访存延时的解析模型。对于访存带宽的建模，本文使用Ｄ

7、ＤＲ效率对访存带宽进行评估，通过分析访存请求地址踪迹，收集时序参数，汁算ＤＤＲ效率。最后，将解析模型所得性能参数与基于ＤＲＡＭＳｉｍ２仿真器的仿真结果进行比较，评估解析模型的适用性和精确性，。实验表明，与仿真模型结果相比在不同实验配置下，所得访存性能延时的误差均小于１０％，访存带宽的误差均小于２０％，具有较好的精确性，。同时，解析模型评估时间减少了８１％大大节省了验证时间。本文所建立的ＤＤＲ存储系统访存性能解析模型，可Ｗ有效的评估ＤＤＲ存储系统的性能。同仿真模型相比，解析模型可Ｗ在更快的时间内给出较为精确的存储系统性能评估结果，

8、实现ＳｏＣ的高效设计。：ＤＤＲ存储系统ＳｏＣ，ＤＲＡＭＳｍ２关隹词，