数字电路综合实习讲稿2006new

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1、数字电路课程设计数字电路课程设计————利用利用CPLDCPLD设计可调时数字钟设计可调时数字钟河北大学电信学院基础教研部河北大学电信学院基础教研部20072007--1212--11学习内容与要求学习内容与要求●掌握掌握MAX+plusMAX+plusIIII软件的使用；软件的使用；●了解了解CPLD/FPGACPLD/FPGA的一般开发步骤；的一般开发步骤；●熟悉用熟悉用CPLD/FPGACPLD/FPGA器件取代传统的中小规器件取代传统的中小规模集成电路实现数字电路与系统的方法模集成电路实现数字电路与系统的方法●了解数字钟的功能要求及设计方法；了解数字钟的功能要

2、求及设计方法；●认识常用元件及使用注意事项认识常用元件及使用注意事项目录目录òòMAX+plusMAX+plusIIII软件基本操作软件基本操作òò数字电子钟课程设计说明数字电子钟课程设计说明òò结果形式及成绩评定结果形式及成绩评定MAX+plusMAX+plusIIII使用简介使用简介软件的学习以加法器为例来说明软件的学习以加法器为例来说明MAX+plusMAX+plusIIII软件的使用方法。软件的使用方法。示例：采用原理图输入方式设计示例：采用原理图输入方式设计88位加法器并进行位加法器并进行仿真分析，最后将程序下载至仿真分析，最后将程序下载至CPLDCPLD（

3、复杂可编程（复杂可编程逻辑器件）芯片中。逻辑器件）芯片中。本设计采用自底向上的层次设计方法，最终本设计采用自底向上的层次设计方法，最终完成加法器设计与实现。完成加法器设计与实现。11、设计输入、设计输入设计输入包括以下步骤：ò（（11）创建原理图文件）创建原理图文件ò（（22）输入逻辑功能图元）输入逻辑功能图元ò（（33）保存文件）保存文件ò（（44）设定项目名称）设定项目名称ò（（55）检查错误）检查错误（（11）创建原理图文件）创建原理图文件创建一个名为half_adder.gdf的文件。步骤如下：a.打开MAX+plusII软件开发环境，如图所示b.选择File

4、→New菜单，或单击，弹出New对话框。c.选中GraphicEditorfile（图形设计文件）单选按钮。在下拉表框中选择.gdf作为文件的扩展名。单击ok按钮。弹出GraphicEditor窗口。（（22）输入逻辑功能图元）输入逻辑功能图元ò在原理图的空白处双击鼠标左键（或选择Symbol→EnterSymbol选项，弹出EnterSymbol对话框。ò在文本框中输入元件名称或用鼠标双击元在文本框中输入元件名称或用鼠标双击元件库；件库；ò选取元件后点击选取元件后点击okok即可；即可；ò如果安放相同元件，只要如果安放相同元件，只要按住按住CtrlCtrl键，同时用

5、鼠标键，同时用鼠标拖动该元件复制即可。拖动该元件复制即可。注：注：primprim库中包含了常用的库中包含了常用的基本门电路和触发器元件符号；基本门电路和触发器元件符号；mfmf库中包含了库中包含了7474系列集成系列集成电路元件符号。电路元件符号。ò半加器所需元件和端口包括：输入端口INPUT、与门AND、异或门XOR、输出端口OUTPUT，它们都在Prim库中。下图为半加器元件安放结果。ò添加连线到器件的管脚上添加连线到器件的管脚上把鼠标移到元件引脚附近，则鼠标光标自动由箭头变为十字，按住鼠标右键拖动，即可画出连线。ò标记输入标记输入//输出端口属性输出端口属性双

6、击输入端口的“PIN-NAME”，当变成黑色时，即可输入标记符并回车确认。输出端口标记方法类似。半加器的输入端分别标记为A、B，输出端分别为S、C。（（33）保存文件）保存文件要保存文件，选择File→SaveAs选项，弹出SaveAs对话框。如图所示。在FileName文本框中输入half_adder.gdf，并在Directories列表框中选择文件的保存目录。注意在MAX+PLUSⅡ中，保存文件目录的路径字符串中不能包含中文字符。(4)(4)设定项目名称设定项目名称选择File→Project→setprojecttocurrentfile选项或图标，可将当前的

7、设计文件指定为当前项目。（（55）检查错误）检查错误为了确保输入的逻辑正确，可以保存文件并检查错误。步骤如下：选择File→Project→Save&Check选项，这将保存上面编辑的文件，并检查输入中的错误。如果没有出现错误，单击OK按钮，关闭消息对话框。单击Compiler窗口右上角的关闭按钮，关闭Compiler窗口。22、电路编译与适配、电路编译与适配电路编译与适配包括以下步骤：ò（（11）选择器件）选择器件ò（（22）设定全局综合适配参数）设定全局综合适配参数ò（（33）编译、适配）编译、适配（（11）选择器件）选择器件ò选择Assign→