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时间:2019-03-03
《基于nios的容错电路的开发与验证-中华大学专题报告》由会员上传分享,免费在线阅读,更多相关内容在教育资源-天天文库。
1、中華大學資訊工程學系專題報告容錯電路的開發與驗證指導教授:陳永源博士學生:B09202043呂凱平B09202142丁瑞蘭B09202166吳嘉恩專題編號:::PRJ2006:PRJ2006PRJ2006-PRJ2006---CSIECSIECSIE-CSIE---9514951495149514中華民國九十六年一月-1-摘要現在資訊科技的日新月異,晶片的單位面積可容納的單位已越來越多,同一個功能晶片的單位面積以經越來越小,因此現在的晶片幾乎都是以複合式的方式把許多的功能整合在一起。這也代表了此晶片會越來越容易受到外部干擾或者內部干擾
2、影響而改變了其中的訊號。當越來越多的高科技環境使用了這些晶片做成的系統,但這些晶片所作成系統的可靠度卻沒有比以前好,現在晶片越精密越不能受到外在或內部干擾,所以利用嵌入式系統增加自我檢測功能去完成模擬晶片受到干擾後錯誤偵測結果。由於此專題有關SOPC,並且我們也使用到了Altera的NIOS發展板,因此在此對SOPC的發展與設計做了一解說,還有簡單介紹NIOS的一些基本架構。此專題之重點在於將我們設計之coprocessor掛到NIOS板上,而如果讓兩者間能溝通必需透過Wrapper。並在此描述我們設計之coprocessor的系統架
3、構,還有coprocessor之其主要功能,做加法運算配合容錯的機制能做到自我檢測錯誤的能力,我們也學習將硬體架構改變模擬錯誤發生環境去檢測偵錯的效能,並將最後的驗證結果呈現作為專題研究的紀錄。-2-銘謝這份專題能順利完成,首要感謝我們的指導教授陳永源博士辛勤的指導,傳授了我們許多業界的理念與想法,以及整合軟硬體的觀念,使我們不僅在學識有所增長更在研究方法上獲益良多。感謝彭建閔學長及陳信宇陳信宇學長在三下至今的專題製作上熱心的教導與系上的老師顏金泰教授在三下的計算機組織結構用心教學下,使我們很快的在作專題時能進入狀況,也解決了不少觀念
4、上的問題。感謝在我們專題上建議的張坤均學長和劉威成學長,感謝對於我們專題的幫助與專題報告上的建議。-3-目錄摘要.................................................................2銘謝.................................................................3第一章導論........................................................61.1簡介.............
5、............................................61.2研究過程....................................................7第二章發展平台介紹..............................................92.1SOPC發展....................................................92.2SOPC設計流程....................................
6、...........102.3SOPCBuilder...............................................122.4Nios處理器概述............................................142.5Nios處理器架構............................................16第三章系統規格架構.............................................183.1系統環境...............
7、.....................................183.1.1環境設定..................................................183.1.2系統架構........................................203.2實驗板介紹與使用..........................................21第四章CoCo-Co---processorprocessorprocessor之容錯系統簡介processor........
8、...........................25-4-4.1CoCoCo-Co---processorprocessorprocessor硬體架構processor.......................
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