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时间：2019-02-19
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1、数字逻辑实验报告实验实验名称：全加器及加法器IC的应用专业班级：学号：姓名：实验时间：指导老师:实验二全加器及加法器IC应用一、实验目的1.掌握加、减法运算器的基木原理及其相应组合逻辑电路的实现。2.掌握集成电路运算器74283的用法。3.掌握基于74283的BCD加法器的设计。4.设计基于74283的余3码产生电路。5.设计基于74283的一位BCD码加法器。二、实验要求1.在Proteus仿真环境下设计半加器电路，并仿真验证。2.在Proteus仿真环境下设计全加器真值表设计相应的电路，并仿真验证。3.设计基
2、于基于74283的8位二进制加、减法运算器，并仿真验证。4.设计基于74283的余3码产生电路，并仿真验证，用7_SEG_BCD显示运算结果。5.设计基于74283的一位BCD码加法器，并仿真验证，用7_SEG_BCD显示运算结果。三、实验内容、实施方案与结果分析1.半加器真值表ABSc0000011010101101•>XrileV4i<1*LaWw•••SvMcbBbI*♦+欽QqqXXZ^BB*>ZAZat!.：2miTITl.E>ISISPiof3、LEO・KK»—4»—11H-ooooA1oo1►—4ooB>—4o1ooH-4ocoo1o11os>—41ooooc1(1)说明：当CO二0吋，为加法器，当C0=l吋，为减法器。4.74283的余3码产生电路⑴说明：余3码rfl8421码加3而得可知，B端应定为0011,C0端定为0。5.基于74283的一位BCD码加法器(1)当第一次和在()〜9时，第二次和不变；在1()〜18时，第二次和二第一次和+()11()。
3、LEO・KK»—4»—11H-ooooA1oo1►—4ooB>—4o1ooH-4ocoo1o11os>—41ooooc1(1)说明：当CO二0吋，为加法器，当C0=l吋，为减法器。4.74283的余3码产生电路⑴说明：余3码rfl8421码加3而得可知，B端应定为0011,C0端定为0。5.基于74283的一位BCD码加法器(1)当第一次和在()〜9时，第二次和不变；在1()〜18时，第二次和二第一次和+()11()。
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