宽带低相位噪声v波段频率综合器研究

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1、声明本学位论文是我在导师的指导下取得的研究成果，尽我所知，在本学位论文中，除了加以标注和致谢的部分外，不包含其他人已经发表或公布过的研究成果，也不包含我为获得任何教育机构的学位或学历而使用过的材料。与我一同工作的同事对本学位论文做出的贡献均已在论文中作了明确的说明。研究生签名：≯刃J3年3月≯】，日学位论文使用授权声明南京理工大学有权保存本学位论文的电子和纸质文档，可以借阅或上网公布本学位论文的部分或全部内容，可以向有关部门或机构送交并授权其保存、借阅或上网公布本学位论文的部分或全部内容。对于保密论文，按保密的有关规定和程序处理。研究生签名：■平毯邡年岁月堋硕士论文宽带但摘要现代通信和

2、雷达技术发展尤为迅速，其系统对频率源的需求也越来越严格，同时这也是未来发展的一个必然趋势。现在研究的主要性能指标包括相位噪声、频谱纯度、跳频时间、工作的带宽和频率稳定度等。目前低频段的频率源可以采用普通PLL技术可以实现，但是在高频段如V波段我们不仅要求有一定的带宽，而且还要满足频率源输出较好的相位噪声，只靠PLL锁相环技术很难去实现。如果采用普通的数字锁相方式实现，再倍频到所需要的频段，其相位噪声恶化比较严重，导致最终输出的结果满足不了高相噪的要求。因此，基于DRO(介质振荡器)的取样锁相技术得到了重视和应用。取样锁相技术和数字锁相技术相比，电路较为复杂，其缺点也比较明显，输出频率带

3、宽较窄，而且调试也比较复杂。本文主要研究的是V波段宽频带低相噪的频率合成器，目标实现50．53GHz频率范围内的相噪指标为．73dBc／Hz@1KHz，．83dBc／Hz@10KHz，．93dBc／Hz@100KHz。本文主题思想是利用取样锁相频率合成器的低相位噪声、输出频率高等优点，并结合数字锁相PLL技术生成一个宽频带低相噪的S波段频率源，将两者经过混频、倍频、滤波、放大处理后得到即有低相位噪声的特点，同时也满足了较大带宽的要求的频率源。论文开始阶段概述了锁相环的工作原理和过程，并分析了取样锁相电路中捕获电路的工作原理和再完成电路的绘制。通过最终V波段频率合成器的相噪要求，反推到取

4、样锁相频率合成器和s波段频率合成器这两个模块，并计算出各个模块相位噪声的最低要求，再对各个模块的电路图进行设计、仿真，从理论上得到了证明其可行性，最后完成调试工作。关键词：PLL，取样锁相，相位噪声，DRo介质振荡器，环路滤波器，捕获电路AbstractAlongwiththerapiddevelopmentofmodemco础mullicationsteclⅡ10109ya11dradar，the行equencysourceinthesystemrequirementsaredemandinghi曲perfonnance，andit’salsoatrendofme向tllredeve

5、lopment．No、vadays，themainperfomlanceindicatorsweconsideredincludephasenoise，spectralp嘶ty，舶quencyj眦1pingtime，theballdwidnla11dtlle行equencystabilit)，．LowbaJld矗equencysourcecaJlbeachieVedbyuset11eordinaryPLLtecllIlology，However，suchastheV-baIldinhi曲矗equencies，ItisdimculttoachieVeifwenot0111yrequire

6、sacertainrangeofbaJld、Ⅳidm，butalsotosatis矽ourrequestoflowerphasenoise舶mme矗equencysourceusetllePLLteclul0109y．0nlyusethePLLtecllll0109ytoachievea舶quencysynthesizer，menacllievethe能quencywew觚tbythemultiplier．However，thephaSenoiseofthefrequencydeteriorationVeryseriousandcallnotachieVeanidearesult、vh

7、ichweneed．Therefore，basedonthesanlplingphase—locked【)R0teclul0109yisreceivingmoreattentionandapplication．ComparedthesaI】叩1ingphase-10ckedteclul0109ywithmePLLteclul0109y，thecircuitisnotonlymoreconlplex—utalsohaSthenarrowbandw