基于bist的带时延故障的fpga测试

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1、哈自；滨：【：张人学硕士学位论文摘要熬着超大蕊模集成毫潞豹逐速发装，∞绡寒技术溅经应焉，上手7j门瓣集成电路已经产生。一方磋酝芯片封鼗越来趟小，引脚越来越密，印制电路扳豹密发目益增大，芯片的互连测试成为一个受德解决的阏题。另一方蕊，芯片或功能模块内部有很多节点无法探溯，对这黧节点和功能块铡试题又一个澳4试的难题。随着集成电路的进一步发展，使用外部设备测试电路板将更加困难。近年来提窭豹霹溺毪竣诗国eSi器fof彘鞋两滁y'DF蛩威了簿决上述溅试嗣瑟熬有效途径。自测试时常是在软件中实现的，懊～种纯软件自测试方法在系统缀满足凝求时，会有若于缺点。这种测试可能诊断分辨率麓。此外，～种

2、受好的软释威测试可畿开发时间很长、穰徽，而且费褥大。一种越来越受到注意的方法是内建自测试(BuiltinSelflbkBISD一也就是在硬件本身中实现自测试。然瑟辘跑工程镁域，螯痰对瑷场霹壤疆f1瘁翻《甄eldP∞静麟m曲leGate加TaMFPGA)的BIST测试技术成功腹用的报道并不多，{乍者的工作就是基于以上事变展开豹。本论文主隳讨论韵熄可编程逻辖器件FPaA的BlST理论、方法和斑用。重．蠢对BI辨溯试生成算法、设计、应用避褥了探讨。本文讨论了BIST设计原理和方法，研究了FPGA故障模型，基于这些模鍪、驻毽秘方法，臻究了BlST溅谈激动豹∥釜爨测试螭应豹分瓣方法，对

3、测试激励产生嚣和测试响应分析器进行了改进，提出一种基予遗传算法(GenerationAlgoritllm，GA)和线性反馈移位寄存器(】■nearFeedbackshin嚣辔ste啦砖R)方法的溺试淘耋产垒箨法，该簿法髓对辩廷蔽簿避稃溪l试，势戆提高测试效率，同时能有效降低电路功耗。本文对FPOA自修复技术进行了尝试经攘讨，提撼一秘瓤骆避接生硬我模型。论文最后设计了一个炭铡，验谖丁本论文方法对FPGA器件的自修复技术的有效性。理论研究、实验和仿舆结果验诞了文中撮出的算法和设计方法的正确性。关键谪：现场可编程门阵列；内建囱测试；内建自修复；大规模集成电路；可测性设圣}喻尔滨工穰

4、火学硕十学能论文AbstractWi氆thespeedydeveiopme瞰o￡VeryL矗fgeScaleh把gfatedCi融王its(V塔王sX90nanometeflechnologyhasbeenappliedlocurrent111tegra￡edciFcI】its(1C)Tnanufacturing．Num髓ouschips也乱cOntainmOre山an10milliongatesarebeingp国ducc(1．S辩aller勰dsmailer国e馥{秘pa馥agesbeco鄹嚣，如nseliera聪densel激thechippinsplace，andmo

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