基于cpld的棋类竞赛计时钟

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1、课程设计课程名称嵌入式系统课题名称基于CPLD的棋类竞赛计时钟专业电子信息工程班级电子信息0801学号姓名指导教师2011年11月24日课程设计任务书课程名称：嵌入式系统题目：基于CPLD的棋类竞赛计时钟专业班级：电子信息0801学生姓名：指导老师：审批：任务书下达日期2011年11月24日设计完成日期2011年12月8日设计内容与设计要求CPLD为复杂可编程逻辑器件，通过EDA技术对其进行编程，可将一个较复杂的数字系统集成于一个芯片中，制成专用集成电路芯片，并可随时在系统修改其逻辑功能。有关知识可参见相关教材或参考书。一．设计内容设计并制作一个用于棋类比赛的计时钟系统，功能要求如下：1.

2、该计时钟可分别完成甲乙对规定用时的计时和规定时间用完后的读秒计时。2.规定甲乙双方各有2小时比赛规定用时，分别设计各方的用时定时器，并用数码管显示各方已用的时、分从0：00～1：59计时间隔为1S。3.2小时规定时间用完后，每方限定在30秒内必须下出一步棋，此时定时器将完成对读秒时间的30S倒计时，并数码管显示此时过程30～00。若计时到零，则发生警报信号该方超时负。4.各定时器设置计时暂停/继续键，在规定时间计时时，该键的作用为暂停本方计时，并继续对方计时；在读秒时间计时时，该键的作用为复位本方计时起始点29S，并启动对方定时器。二、设计要求：1、设计思路清晰，给出整体设计框图；2、在M

3、AX+PLUSⅡ中设计各单元电路，完成其功能仿真和编译并生成低层模块；3、在MAX+PLUSⅡ中完成顶层设计并编译通过；4、在MAX+PLUSⅡ中完成设计下载并调试电路；5、写出设计报告；主要设计条件1.提供EDA实验室；2.提供EL实验箱和CPLD芯片;3.提供ALTERA公司的MAX+PLUS10.1设计软件说明书格式1.课程设计封面；2.任务书；3.说明书目录；4.设计总体思路，基本原理和框图（顶层电路图）；5.单元电路设计（各次级模块电路图）；6.设计仿真；7.编程下载；8.总结与体会；9.附录；10.参考文献。进度安排星期一、二：下达设计任务书，介绍课题内容与要求；介绍MAX+p

4、lusⅡ软件的使用；查找资料，确定总体设计方案和单元电路设计；星期三～第二周星期一：单元电路设计与仿真，硬件下载；第二周星期二、三：硬件下载；第二星期四、五：书写设计报告，打印相关图纸；答辩参考文献1.康华光主编.电子技术基础（数字部分），高等教育出版社。2.阎石主编.电子技术基础（数字部分），清华大学出版社。3.陈大钦主编，电子技术基础实验，高等教育出版社。4.彭介华主编，电子技术课程设计指导，高等教育出版社。5.张原编著，可编程逻辑器件设计及应用，机械工业出版社。6.荀殿栋，徐志军编著，数字电路设计实用手册，电子工业出版社。7.MAX+PLUSⅡ入门8.刘洪喜，陆颖编著.VHDL电路设

5、计实用教程清华大学出版社目录1.总体设计思路11.1基本原理11.2总体设计框图22.单元电路设计32.1控制模块32.2选择模块42.3显示模块22.4报警模块22.5计时模块23.总体设计思路34.总结与体会45.附录55.1总电路图55.2参考程序66.参考文献151.总体设计思路1.1基本原理本次设计的基于CPLD的棋类竞赛计时钟可以用于棋类竞赛参赛双方对规定用时的计时和规定时间用完后的读秒计时。棋类竞赛规则为：AB两方参赛选手分别有2小时的比赛固定用时，因此需要设计AB两位参赛选手都需要的计设备，用于0—1:59分钟的计时使用。当组委会规定的的2小时固定时间用完后，则需限定AB双

6、方在30s内必须下出一步棋，此时定时器将完成对30s的倒计时，并通过连接一个警报器以告知双方比赛结果。两方若任意一人计时到零，则他方的警报灯便会亮起，便告负；反之，另方灯亮起则他方为负。并且各定时器设置计时暂停/继续键，可用于双方比赛时对时间的计时。而在30s倒计时工作时，该键的作用为复位本方计时起始点29S，并启动对方定时器。设置系统复位键，比赛结束时，按该键使各方的定时器均复位到0：00，以便重新开始比赛。控制模块是本次设计的核心，他起到对双方选手时间的控制包括对暂停请求、即时转换等核心功能。选择模块的设置，是为了很好解决显示管数量不足的问题。在输入暂停继续开关的作用下，轮流显示参赛

7、双方所用时间情况给显示模块。显示模块是一个动态扫描显示电路。在一个人眼观察不出的扫描频率下，轮流在相对应的显示管上显示输入端口的输入的数据。30s倒计时器的输出同时也控制着报警模块的工作，当甲乙任一方所有时间都用完时，报警模块输出报警信号，宣布比赛结束，谁的时间先用完谁就输了。231.2总体设计框图输入控制模块A2小时计数器B2小时计数器B30秒计数器A30秒计数器报警模块选择模块输出报警信号显示模块显示时间232.单元