多功能电子钟的verilog设计

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1、多功能电子钟的Verilog设计学生：黄海平指导老师：廖泰长摘要：Verilog是广泛应用的硬件描述语言，可以用在硬件设计流程的建模、综合和模拟等多个阶段。随着硬件设计规模的不断扩大，应用硬件描述语言进行描述的CPLD结构，成为设计专用集成电路和其他集成电路的主流。通过应用VerilogHDL对多功能电子钟的设计，达到对VerilogHDL的理解，同时对CPLD器件进行简要了解。本文的研究内容包括:对Altera公司Flex10K系列的EPF10K10简要介绍，Altera公司软件Max+plusⅡ简要介绍和应用Veril

2、ogHDL对多功能电子钟进行设计。关键词：多功能电子钟；硬件描述语言Abstract：Verilogisthemostwidelyusedhardwaredescriptionlanguage.Itcanbeusedtothemodeling,synthesis,andsimulationstagesofthehardwaresystemdesignflow.Withthescaleofhardwaredesigncontinuallyenlarging,describingtheCPLDwithHDLbecomethem

3、ainstreamofdesigningASICandotherIC.TocomprehendVerilogHDLandgetsomeknowledgeofCPLDdevice,wedesignablockwithseveralfunctionswithVerilogHDL.Thisthesisisabouttodiscusstheabovethereaspects:IntroducetheEPF10K10ofFlex10KseriesproductedbyAlteraCorporationsimply.thesoftwa

4、reMax+plusⅡ,DesigntheblockwithseveralfunctionswithVerilogHDL.Keywords:blockwithseveralfunctions;hardwaredescriptionlanguage目　　录1引言21.1课题的背景、目的21.2课题设计环境22　EPF10K10相关说明及VERILOGHDL简介22.1　EPF10K10相关说明22.2VerilogHdl硬件描述语言简介43应用VERILOGHDL描述的多功能电子钟53.1功能描述53.2源程序63.3模块仿

5、真134应用VERILOGHDL描述的多功能电子钟功能模块及仿真154.1计时模块154.2闹铃设置模块174.3校时模块194.4秒表功能模块224.5整点报时模块254.6闹铃屏蔽及响铃功能274.7秒表提示铃声功能285结束语306致谢30参考文献31多功能电子钟的Verilog设计第33页共32页多功能电子钟的Verilog设计第33页共32页多功能电子钟的Verilog设计第33页共32页１引言随着电子技术的发展，现场可编程门阵列FPGA和复杂可编程逻辑器件CPLD的出现，使得电子系统的设计者利用与器件相应的电子

6、CAD软件，在实验室里就可以设计自己的专用集成电路ASIC器件。这种可编程ASIC不仅使设计的产品达到小型化、集成化和高可靠性，而且器件具有用户可编程特性，大大缩短了设计周期，减少了设计费用，降低了设计风险。目前数字系统的设计可以直接面向用户需求，根据系统的行为和功能要求，自上至下地逐层完成相应的描述﹑综合﹑优化﹑仿真与验证，直到生成器件，实现电子设计自动化。其中电子设计自动化（EDA）的关键技术之一就是可以用硬件描述语言（HDL）来描述硬件电路。VHDL是用来描述从抽象到具体级别硬件的工业标准语言，它是由美国国防部在80

7、年代开发的HDL,现在已成为IEEE承认的标准硬件描述语言。VHDL支持硬件的设计、验证、综合和测试，以及硬件设计数据的交换、维护、修改和硬件的实现，具有描述能力强、生命周期长、支持大规模设计的分解和已有设计的再利用等优点。利用VHDL这些优点和先进的EDA工具，根据具体的实际要求，我们可以自己来设计串口异步通信电路。1.1课题的背景、目的　　二十一世纪是信息化高速发展的世纪，产业的信息化离不开硬件芯片的支持。芯片技术的进步是推动全球信息化的动力。因此在二十一世纪掌握芯片技术是十分有必要的。本次课题是计算机组成原理的课程设

8、计，这次课题旨在通过自己对所需功能芯片的设计与实现来巩固以前所学的计算机硬件基础知识，同时也提高动手实践的能力，还有为将来进行更大规模更复杂的开发积累经验。1.2课题设计环境　本次课题设计方要用到的开发环境是Altera公司的EDA设计工具软件MAX+plusII。Altera公司的工作与EDA厂家紧密