eda2设计报告多功能数字钟设计

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1、EDA(II)实验报告——多功能数字钟设计摘要本实验利用ALTERA公司的QUARTUSII开发平台，对Cyclone系列的EP1C12Q240C8芯片进行开发，以实现数字钟。具体功能有：计时，校时校分，清零，闹铃，整点报时等。AbstractInthisstudy,thecompany'sQUARTUSIIALTERAdevelopmentplatform,ontheCycloneseriesEP1C12Q240C8chipdevelopmenttodigitalclock.Specificfeaturesinclude:time,schoolhours

2、whentheschool,clear,alarm,andsothewholepointtimekeeping.关键字FPGAQUARTUSII设计多功能数字钟Keywordsmulti-functiondigitalclockFPGAQUARTUSIIdesign一、设计要求说明二、方案论证三、各子模块设计原理1、脉冲发生模块(1)48分频(2)1000分频(3)计时信号的产生2、模块设计(1)24小时模块(2)报时电路模块(3)较时较分清零模块说明(4)闹钟模块1•闹钟清零2•闹钟较分较时3、译码显示模块(1)译码显示(2)显示转换模块4、整体电路构成

3、附各开关使用说明四、编译及仿真下载1、编译2、下载五、结论六、设计感想1、设计过程中遇到的问题及解决方法2、设计的收获与感受七、参考文献筱针报告1、能进行正常的吋、分、秒计吋功能；2、分别由六个数码管显示时分秒的计时;3、K1是系统的使能开关4、K2是系统的清零开关5、K3是系统的校分开关6、K4是系统的校吋开关（K1二0正常工作，K1二1时钟保持不变）；（K2二0正常工作，K2二1时钟的分、秒全清零）;（K3二0正常工作，K3二1时可以快速校分）；（K4二0正常工作，K4二1吋可以快速校吋）；1、使时钟具有整点报时功能（当时钟计到59'53”时开始报时，

4、在59'53”,59'55”，59'57”时报时频率500Hz,59,59”时报时频率为lKHz,）；2、闹表设计功能;二.方秦笹证本次实验是通过脉冲发生电路产生1Hz的频率作为计时电路的脉冲，计时电路是由两个模60的电路分别作为秒和分，一个模24的电路作为时，计时电路通过译码显示电路在七段数码管上显示；校分校时电路则是通过一个或门分别与秒的进位信号和分的进位信号相或，用或门的输出端控制分和时的计数器使能端使其计数；清零电路则是通过控制秒、分、时的计数器的清零端，使其一并清零；报时电路是根据所要求的时间由计时电路产生反馈信号再跟要求的报时频率相与后输出端跟

5、蜂鸣器相连即可产牛相应频率的报时信号。木次实验是通过将48MHz的频率进行一次48分频和两次1000分频得到1Hz的频率。1)48分频原理图：rvgc：74163BQACQBDQCENTQDENPRCOCLRNCLKLDNALW-L.COUNTER••••••••••••••••••fl.4…i;OLDNADQA—4CQBi—1DQCENTQDENPRCO—1CLRNCLK74163hutlCOUNTER仿真后得到波形如下:D^05X048分频的实现是通过一次16分频和一次3分频来完成的，将得到的48分频电路封装后如下：548feng48mXabinst4

6、22)1000分频原理图：LDNABQACQIDOCWOORCOCIRMCLK?4赠」・LL・L・L」・X•••••■■741$3••••••4-cLDN•••:—A••:—IQA•j—CQ8••0QC■■TonTOWRCO•:•■i-CCLRNCIK••••:...COUNTER.741WLONABQAC080QCeNiQDeNpRCOCLRNCLK■.??....CQUNTER:丁二兀…茫…；••••••••••■■•■■・■•♦■♦•••―••■•1000分频是通过三次10分频来实现的，并通过芯片的输出端实现了各种讣吋频率的输岀，将其封装后如下：10

7、OOfenginst3>计时信号的产生Z针时兹今兹时及術眾模块1>24小时模块原理图如下：*IAI02•741607416074160fiitrtoigiiiri'己三LDNABOACQBDQCEtfTQDENPRCOCIRNCLKi."...COUNT曰寸*ir-*5f"Ci74160•-ION•ABQACQB0QCENTQD1ENPRCO1CLRNCLKlMl>COUNTER>KAiri2P*Ut"*ut-LONABOACQBDQCENTQDENPRCOCLRNCLK74160>»«..COUNTERLDNA90ACnQBnrENTUJQDQpnCLR

8、NCLKCOUNTERLDNAQAcQBDQCENTQDENPRC