第3章习题解答 数字电路.doc

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1、第3章时序逻辑基础习题3表3-4SnXnZn01S0S0S10S1S0S20S2S3S20S3S4S00S4S0S50S5S5S11Sn+13-1解该电路的状态图如图3-5所示，为摩尔型电路。输入序列：11100101状态序列：S0S1S2S2S3S4S5S5S1输出序列：00000110最后一位输入后电路处于S1状态。00011001101S0/0S1/0S2/0S3/0S4/0S5/11XSi/Z图3-5表3-5XnSn01AA/0C/0BA/0C/1CC/0D/0DA/0B/0Sn+1/Zn3-2解该电路的状态表如表3-5所示，为米里型电路。输入序列：1011101状态序列：

2、ACCDBCCD输出序列：0000100最后一位输入后电路处于D状态。3-3解逻辑符号如图3-8所示，真值表如表3-6所示，工作波形如图3-9所示。QQSR图3-8表3-6SRQn+100011011Qn01FSRQQ图3-93-4解输出波形如图3-11所示。CPSR图3-10QQ图3-113-5解Q端波形如图3-13所示。3-6CPD图3-12JCPK图3-14Q图3-15Q图3-13解Q端波形如图3-15所示。3-7TCPQ图3-17解Q端波形如图3-17所示。图3-16TCPQQ1TC13-8CPQCPQCPQ(a)(b)(c)图3-19解各触发器的Q端波形分别如图3-19(

3、a)、(b)、(c)所示。JCPKPRCLR图3-21Q3-9解Q端的输出波形如图3-21所示。1J1KC1QQCPJKRSCLRPR图3-203-10解Q1、Q0的输出波形如图3-23所示。CLKXQ1Q0图3-23图3-221DCLKQ1Q1SRC11J1KC1Q0Q0RSX3-11解8进制异步行波加法计数器电路如图3-24所示。图3-24CLK1DQ0Q0C11DQ1Q1C11DQ2Q2C13-12解4进制异步行波可逆计数器电路如图3-25所示。CLK图3-251J1KC1Q0Q01J1KC1Q1Q1=1X11113-13解5进制异步加法计数器电路如图3-26所示。CLK1T

4、Q0Q0SRC1111TQ1Q1SRC1111TQ2Q2SRC111&图3-263-14解8进制同步减法计数器电路如图3-27所示。图3-271TQ0Q0C11TQ1Q1C11TQ2Q2C1&1CLK3-15CLK图3-281J1KC1Q0Q01J1KC1Q1Q1=1X11解4进制同步可逆计数器电路如图3-28所示。3-16解用7493构成的13进制和172进制计数器电路分别如图3-29和图3-30所示，因为13=(1101)2，172=16´10+12。7493CPACPBR01R02QDQCQBQA&CLK图3-29Z图3-30Z7493CPACPBR01R02QDQCQBQA

5、CLK7493CPACPBR01R02QDQCQBQA&3-17分别用74163构成8421BCD和5421BCD加法计数器，并画出全状态图。解8421BCD加法计数器及全状态图如图3-31所示，采用同步清0方式变模。1174163COCLRCPPTQDQCQBQALDDCBACLK1&0000000100100011010010011000011101100101101010111100110111111110图3-315421BCD加法计数器及全状态图如图3-32所示，采用预置方式变模。根据5421BCD码的编码规律，当QDQCQBQA=0100时，下一个CP脉冲应置入1000

6、；当QDQCQBQA=1100时，下一个CP脉冲应置入0000。因此，当QCQBQA=100时应使74163处于置数状态，即，且预置数。图3-3211174163COCLRCPPTQDQCQBQALDDCBACLK000≥11100000001001000110100110010111010100110000101011001111101111111103-18直接用74163级联构成256进制同步加法计数器。解256进制同步加法计数器电路如图3-33所示。图3-331174163COCLRCPPTQDQCQBQALDDCBACLK74163COCLRCPPTQDQCQBQALDD

7、CBA111113-19用74162构成2~100进制程控加法计数器。当构成41进制计数器时，预置数Y为多少？解程控加法计数器如图3-34所示。当构成41进制计数器时，预置数Y=59并以8421BCD码形式输入。图3-34Y7Y6Y5Y4Y3Y2Y1Y0预置数Y1174162COCLRCPPTQDQCQBQALDDCBACLK174162COCLRCPPTQDQCQBQALDDCBA1113-20解用预置法和清0法构成的6进制加法计数器及状态图分别如图3-35和图3-