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时间:2018-12-08
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1、赛灵思推出Vivado设计套件HLx版本,助力SoC和FPGA以及打造可复用的平台 赛灵思公司推出Vivado设计套件HLx版本,为AllProgrammableSoC和FPGA以及打造可复用的平台提供了全新超高生产力设计方法。新版HLx包括HL系统版本、HL设计版本和HLWebPACK版本。所有HLx版本均包括带有C/C++库的Vivado高层次综合(HLS)、VivadoIP集成器(IPI)、LogicCOREIP子系统以及完整的Vivado实现工具套件,使主流用户能够方便地采用生产力最高、最先进的C语言和IP设计流程。结合最新UltraF
2、ast高级生产力设计方法指南,相比采用传统方法而言,用户可将生产力提升10-15倍。全新HLx版本将作为Vivado设计套件的免费升级版提供。 为创建和编程可复用的平台工作带来超高生产力 过去3年来,赛灵思前沿客户率先采用基于C语言和IP的设计技术与方法,并推动有关技术和方法不断完善,走向成熟,这些成熟的技术和方法现已纳入HLx版本中,实践证明有望将生产力提升10-15倍。为了实现这一超高生产力,客户采用了如下全部或部分设计技术与方法:1)基于C语言的设计和优化再利用;2)IP子系统的复用;3)集成自动化;4)加速设计收敛。 有别于将大部分
3、设计精力用在设计流程后端的传统RTL设计,基于C和IP的设计可以支持广泛的优化设计复用,以加速更出色的微型架构的创建和快速探索更多设计的可能性,而且还能取代易出错的手动C到RTL转换,避免在集成基于C语言和RTL的IP时浪费时间和出错,并可大幅缩短验证时间。利用高层次抽象,客户发现他们能够快速获得整体同样出色甚至更好的结果质量(性能、功耗和利用率)。 为了支持这些高生产力的设计流程,全新HLx各版本均包括VivadoHLS、VivadoIPI、LogicCOREIP子系统和完整的Vivado实现工具套件。此外,赛灵思及其联盟生态系统还在不断扩展
4、特定市场的C语言库,诸如针对视频和图像处理的OpenCV,以及面向汽车驾驶员辅助系统(ADAS)和数据中心应用的机器学习等。赛灵思的全新LogiCOREIP子系统是一种高度可配置的、专为特定市场量身定制的构建模块,其集成了多达80个不同的IP核、软件驱动程序、设计范例和多种测试平台。新型IP子系统可用于以太网、PCIe、视频处理、图像传感器处理以及OTN开发。这些IP子系统采用AMBAAXI4互联协议、IEEEP1735加密和IP-XACT等业界标准,可与赛灵思及其联盟成员提供的IP实现互操作,并加速集成。 基于C的IP和预封装的IP子系统相结
5、合,能利用VivadoIPI实现集成自动化。VivadoIPI的集成自动化提供了具有器件和平台感知的互动开发环境。该环境可支持关键IP接口的智能自动连接、一键式IP子系统生成、实时DRC,以及接口更换通知,同时还具备强大的调试功能。具有平台感知的智能功能可对ZynqSoC和MPSoC处理系统预先配置适当的外设、驱动程序和存储器映射,以便支持目标开发板。设计团队现在能够针对ARM处理系统和高性能FPGA逻辑快速识别、重用并集成软硬件IP核。 赛灵思公司设计方法市场营销高级总监TomFeist指出:“全新HLx版本设计套件提供了用于创建和编程可复用
6、的AllProgrammable平台的架构。我们所有的Vivado套件均提供有高级工具、IP和UltraFast设计方法,让我们的主流客户能够集中精力实现差异化价值,更快速地打造出更出色的设计。”HLx配合补充SDx以创建并部署平台 HLx可帮助硬件工程师加速AllProgrammable平台的创建、修改和编程工作,并进一步完善了赛灵思专为软件和系统工程师量身定制的SDx开发环境(SDSoC、SDAccel和SDNet)。SDx系列开发环境能用C、C++、OpenCL和用于数据包处理的新兴P4语言的组合通过HLx生成的平台进行软件定义编程。HL
7、x和SDx代表了赛灵思设计实现解决方案的新时代,为用户借助ZynqSoC、MPSoC、ASIC级FPGA和3DIC等新一代AllProgrammable器件开发更智能、互联互通的差异化系统提供强大支持。供货情况 全新HLx升级版现已在Vivado设计套件2015.4版本中提供,支持赛灵思7系列、UltraScale和UltraScale+器件。下载最新版,敬请访问:china.xilinx.com/download。如需了解更多信息,敬请观看VivadoQuickTake视频,注册参加培训,并充分利用UltraFast设计方法指南(适用于Viv
8、ado设计套件)以及最新UltraFast高效生产力设计方法指南(适用于Vivado设计套件)。
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