安工大数字逻辑试卷11-12ans

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1、2011〜2012学年第二学期期末考试《数字逻辑》试卷(A)标准答案和评分标准一、填空题(每空1分,共22分)1、该时刻电路输入信号的取值组合2、高电平,低电平,高阻态(次序不论)3、增加冗余项(或修改逻辑设计),增加惯性延时环节(或滤波法),选通法(次序不论)4、最小项之和(或标准积之和、标准与或式),最大项之积(或标准和之积、标准或与式)(次序不论)5、[AB+AC+C(D+£)]•£,[AB+AC+C(D+£)]■£6、真值表7、输出函数表达式(或输出方程),激励函数表达式(或驱动方程),次态函数表达式(或状态方程)(次序不论)8、逻辑1,逻辑09、即时输入

2、,输入历史10、任意两个相邻的数其格雷码仅有一位不同11、CPLD,FPGA(次序不论)二、单项选择题(每题2分,共28分)1~5CBADB6~10ABCBD三、分析题(共20分)3—_I•解:y=mi£)•=>F=AB'1+AB-C4-AB-C11~14DACA=>F=^4C+BC(4分)由表达式可知,C具备竞争条件,且当AB=00时,F=C+C则当AB=0埘,C的变化可导致F出现0型险象。(4分)2、解:(1)由电路图可写出驱动方程:(2分)=Q^D=Q:,'=Q^d3=Qi(2)将驱动方程代入DFF的特性方程可得状态方程:(2分)Q,=D0=Q^Q^=L

3、==D2=Q^Qr=L=Q^2oerQ3er1er+,er1er100000000000110000010000100111001010000100101101001100011011110111000010010011100101001011011110111000110110111101110011111111111(3)做状态转换真值表和状态转换图(4分)(4)此电路为模为4的环形计数器,存在挂起现象。Q0Q1Q2Q3:0001+1000+0100今0010」0011+1001+1100今0110」0111+1011+1101+1110」0101+1010

4、00001111」(2分)四、设计题(共30分)1、解:设X、Y、Z表示三个人的表决意见,=1表示赞成,=0表示反对;F表示获奖决议是否通过,F=1表示通过,F=0表示未通过,则真值表为:XYZF000000100100011110001011110111110最小项表达式为:F(X,Y,Z)=^>(3,5,6,7)令74138的输入端C接X,B接Y,A接Z,则用74138实现的逻辑电路图为:Z-y-X-YONAY1N已Y2NCY3NG1Y4NG2ANY5NG2BNY6NY7N74138>40->>3:8DECODER⑽OX.z>评分标准:真值表5分,最小项表达式

5、5分,连线图5分2、解:由题意可得状态转换图:/z令S0=00,Sl=01,S2=10,S3=ll,则状态转换真值表为:2r2oer2o+,z000100110010110110010次态函数表达式和输出函数表达式为-Q?+1=Q?Q1+Q?__Qon+1=Q?Qo+QrO«=Qoz=Q?Q:若用DFF实现,则激励函数表达式为:D、=Q;'®Q;;,D0=Q;;,则逻辑电路图为:评分标准:状态转换真值表5分,表达式5分,逻辑图5分2011〜2012学年第二学期期末考试《数字逻辑》试卷(B)标准答案和评分标准一、填空题(每空1分,共22分)1、真值表2、逻辑0,逻辑

6、13、即时输入,输入历史4、任意两个相邻的数其格雷码仅有一位不同5、CPLD,FPGA(次序不论)6、该时刻电路输入信号取值组合7、高电平,低电平,高阻态(次序不论)8、增加冗余项(或修改逻辑设计),增加惯性延时环节(或滤波法),选通法(次序不论)9、最小项之和(或标准积之和、标准与或式),最大项之积(或标准和之积、标准或与式)(次序不论)10、[AB+AC+C(5+E)]£,[AB+AC+C(D+£)]-£11、输出函数表达式(或输出方程),激励函数表达式(或驱动方程),次态函数表达式(或状态方程)(次序不论)三、分析题(共20分)3__I.解:Y=XmzD,.

7、=>F=AB-C+AB二、单项选择题(每题2分,共28分)1~5BDADC6~10DCBBA11~14DDBAC+AB=>F=fiC+AC(4分)由表达式可知,C具备竞争条件,且当AB=1财,F=C+C则当AB=1财,C的变化可导致F出现0型险象。(4分)2、解:(1)由电路图可写出驱动方程:(2分)z)0=e;,D1=e^D2=e1z)3=22,(2)将驱动方程代入DFF的特性方程可得状态方程:(2分)Go+1=D,=Q^^=D}=Q^Q^=D2=Q;Qrl=D3=Q^erQ203erer1er1er'0000100000010000001010010011

8、00010

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