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时间：2018-11-13
《4线-2线优先编码器》由会员上传分享，免费在线阅读，更多相关内容在行业资料-天天文库。
1、4线-2线优先编码器设计、仿真与实现1.真值表：输入输出I0I1I2I3Y1Y0100000X10001XX1010XXX1112.逻辑关系Y1=X0+X1Y2=X0+X1’X23.Verolig代码实现//A4-2decordermoduleDECODER_4_2(X,Y0,Y1);input[3:0]X;outputY0,Y1;wiren0,n1,n2;not(n0,X[1]);and(n1,n0,X[2]);assignY0=(X[0]
2、n1);assignY1=(X[0]
3、X[1]);endmodule4.QuartusII仿真结果
4、时钟设置：X[0]=10nsx[1]=20nsx[2]=40nsx[3]=80ns输入输出状态表：X[0]X[1]X[2]X[3]Y0Y10000001000110100011100110010101010110110011110110001001001110101011101110011101011110111011111115.FPGA引脚设置
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