电子综合设计模板

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1、徐海学院09届电子技术综合设计报告电子综合设计任务书学生姓名：专业年级：学号：设计日期：设计题目：多功能数字钟设计要求：1．主要内容用CC4518双四位BCD同步加数器设计60秒、60分、24小时归零计时电路；用CC4511七段译码驱动/锁存器及LG5011AH共阴极数码管设计译码及显示电路（数码管需加限流电阻）用脉冲开关设计校准功能用555构成多谢震荡器，实现（f=1HZ）秒脉冲信号发生器2．整体电路原理图60秒（60分）及24小时——计数、编码、译码、显示（4路）用8K纸复印纸手工画3．EWB仿真图60秒（60分）

2、及24小时——计数、译码、显示（6路）计算机打印4．设计原理图用protel99设计原理图并打印5设计PCB版图用protel99设计PCB板图并打印6扩展功能要求设计整点报时功能12小时归1电路摘要17徐海学院09届电子技术综合设计报告1设计说明书.基本功能实现60秒、60分、24小时的计数、译码、显示；具有校准功能自带秒脉冲信号发生器扩展功能定点报时闹时控制仿广播电台整点报时自动整点报时提高功能小时的计数要求为“12归1”功能要求主体电路图1.2.1主体电路思想扩展电路17徐海学院09届电子技术综合设计报告图1

3、.2.2（2）扩展电路其中在主板电路中的秒脉冲信号发送到扩展电路的分频电路中。图2.1方案确定构架17徐海学院09届电子技术综合设计报告图2.3.1（2）60进制计数单元电路图工作原理CC4518技术状态表如右图，由上图得，边为十位计数，右边为个位计数，当个位计数器计到9下个脉冲来时，个位清零并向十位进1，当十位计到6时，Q3Q2为11，Q3Q2相与后为1使清零端工作十位个位同时清零，循环置数。个位向十位的进位脉冲，需用Q4的下降沿,接EN端。图2.3.1（3）24进制计数单元电路图工作原理根据CC4518管脚排列，如

4、图2.3.117徐海学院09届电子技术综合设计报告（3），如60进制，左边管脚控制24进制的高位，逢2清零，故经0010输出；右边管脚控制24进制的低位，逢4清零，故经0100输出，两端输出经过与门，左端与右端同时输出2个4时，高电平有效，从与门出来分别接到MRA与MRB端清零。译码、显示电路CC4511实现译码cc4511真值表图2.4.1cc4511管脚图（1）灯测试功能：LT可检查七段显示器各字段是否能正常发光。当LT=0时，不论Q0－Q3状态如何，七段全部显示，以检查各字段的好坏。（2）消隐功能：当BI=0时，

5、输出a－b都为低电平，各字段熄灭。（3）数码显示：当BI=1LT=1LE=0，译码器工作，当Ｑ3Ｑ2Ｑ1Ｑ0端输入8421BCD码时，译码器对应的输出端输出高电平1，数码显示相应的数字。（4）锁　　存：在LE从“0”转换到“1”时，输出显示由输入的BCD码决定。60进制技术、译码、显示单元电路图2.4.317徐海学院09届电子技术综合设计报告60进制技术、译码、显示单元电路24进制技术、译码、显示单元电路图2.4.3（2）24进制计数、译码、显示电路校时电路S1S2功能11计数10校分01校时校时脉冲功能1HZ快校时单

6、次脉冲慢校时17徐海学院09届电子技术综合设计报告定时报时电路定时报时电路图工作原理：74LS273是带有清除端的8D触发器，只有在清除端保持高电平时，才具有锁存功能，锁存控制端为11脚CLK，采用上升沿锁存。也是一种带清除功能的8D触发器，1D～8D为数据输入端，1Q～8Q为数据输出端，正脉冲触发，低电平清除，而74LS266里面是四个同或门，74LS266的一端连着CC4518的输出管脚，其工作原理为先将时钟调制到用户想要的点数，然后按下开关，74LS273会自动锁存住这一时间，而当时钟下一次运行至这一时间时，三个

7、CC4518会发出高电平信号，连同的74LS273也会发出高电平信号，通过266的同或门后到达74LS21，而74LS21中全是与门，则最终输出高电平，经过三极管，三极管导通，音乐芯片经过扬声器发出声音，达到报时。VCX由石英谐振器、变容二极管和振荡电路组成,通过控制变容二极管的电压来改变变容二极管的电容，从而“牵引”石英谐振器的频率，以达到频率调制的目的。二极管与门工作原理焊接板上的二极管与门电路可以大致表示成以下电路17徐海学院09届电子技术综合设计报告图2.7.3二极管与门工作电路这张电路图中，如果A或者B其中一

8、个电压低于0.7V，此时任意一个二极管导通，电压钳位在0.7V，看表就知道，此时F点的输出电压为0.7V，也就是低电平，用0表示，如果当A、B两点的电压都等于3V的时候，此时两个二极和不导通，F点就输出高电平用1表示，F点接到计数器或者其它的元件上12V是R与D1D2的电源，也为F点提供3.7V的电压如果你需要F点输出高电平AB两