三人表决器五人表决器的实验报告

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1、三人表决器、五人表决器的实脸报告一实验目的1.熟悉QuartusII软件的基木操作2.学W使用VerilogHDL进行设计输入3.逐步掌握软件输入、编译、仿真的过程二实验说明本次实验是要设计一个三人表决器。该电路应有两个数据输入端口blb1，b2，b3,电路的输出端口为voter(ub2voteru输出信号)。b3三人表决器真值表:输入信号输出信号BlB2B3u00000010010001111000101111011111逻辑表达式：U=/?lh2b2b3blb3三实验要求1、完成三人表决器的VeHl

2、ogHDL程序代码输入并进行仿真2、采用结构描述方式和数据流描述方式3、完成对设计电路的仿真验证四、实验过程(1)三人表决器：程序代码voter,v□modulevoter(A,C,Y);inputA,B,C;outputY;wire[1:0]add_result;assignesult=A+B+C;assignY=(add_result>=2)?11tol:11toO;endmodule仿真结果五人表决器:程序代码Hmodulethree_voter_ex;inpUtAjrB.rC^D.rE；outp

3、utY;wire[1:0]adLd_resu11;assign沒dd_i:esult=A+B+C+D+EfassignY=(a_clil_result：＞=3)?11to1:11toO;endrnociule

4、仿真结果五、实验体会通过三人表决器和丑人表决器的设计，使我们更加熟悉Quartus软件进行数字系统设计的步骤，以及运用VerilogHDL进行设计输入，并掌握三人表决器和五人表决器的逻辑功能和设计原理，逐步理解功能仿真和时序仿真波形。三人表决器和五人表决器人体相似，并没有太大的区别。