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时间:2018-10-26
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1、一、(10分)按要求完成下列各题1、化简下列函数为最简表达式(每题2分)1)、F=Σm(1,3,5,7,9)+Σd(10,11,12,13,14,15)2)、3)、2、判断险象(4分)某与非门电路的表达式为的组合电路,试判断单变量状态改变时,有无竟争冒险,若有用增加冗余项的方法消除。二、(18分)分析题1、(10分)分析图1所示逻辑电路。要求:(1)假定输入ABCD为四位二进制码,说明该电路功能;(5分)(2)对电路加以修改,使之实现与原电路相反的功能。(5分)D0D1D2D3A1A0D0D1D2D3A1A0D0D1D2D3A1A0W ⅠⅡⅢW
2、W ABCD10F3F2F1F0图12、(8分)电路如图2所示,设各触发器初始状态均为0。(1)写出电路的状态方程和输出方程;(2)列出状态表,说明电路的逻辑功能。JCIK&JCIK&&XCPQ1Q0图2Z7三、(20分)计算题(10分)1、分析图3所示逻辑电路,设定时器CB555输出高电平5V,输出低电平为0V,D为理想二极管。试回答下列问题:1)当开关置于位置A时,两个CB555各构成什么电路?计算输出信号u01和u02的频率f1和f2(5分)2)当开关置于位置B时,两个CB555构成的电路有何关系?画出u01和u02的输出波形图。(5分)8
3、473Ⅰ65218473Ⅱ6 521R1R227K33KR33.3KR42.7K0.082uF0.082uF0.01uF0.01uFu01u01BAD+5V图3C1C3C4C2CB555的电路结构图7CB555的功能表输入输出T01111××低低不变高高导通导通不变截止截止2、(10分)试求图4电路中的外接负载电阻的RL的取范围。已知G1、G2为OC门,输出管截止时的漏电流为200uA,输出管导通时允许的最大负载电流为ILM=200mA,G3、G4、G5均为74系列与非门,它们的低电平输入电流为IIL=1mA,高电平输入电流为IIH=40uA,给
4、定VCC=5V,要求OC门输出高电平VOH≥3V,低电平VOL≤0.4V。&&&&&G1G2G3G4G5VCCRLACDB图4四、(32分)设计题1、(10分)试用JK触发器设计一个能产生如图5所示波形的同步时序逻辑电路。(提示Z1、Z2的输出实际为0111和0010)Z1Z2CP12345678 ……图572、(12分)试用同步四位二进制计数器74LS161和双4选一多路选择器74LS153设计一个能产生信号01001110……附加控制端S选择控制输入数据输入输出0φφφφφφ01A1A0D0D1D2D3W100D0φφφD0101φD1φφ
5、D1110φφD2φD2111φφφD3D3双4选1多路选择器功能表:S11D01D11D21D3S22D02D12D22D3A1A0双4选1选择器1532W1W74LS161的功能表输入输出功能清0使能置数计数脉冲数据Q3Q2Q1Q0EPETCPD3D2D1D00××××××××0000异步置“0”10××d3d2d1d0d3d2d1d0同步置数1111××××递增计数1101×××××保持11×0×××××保持(C=0)Q0Q1Q2Q374LS161D0D1D2D3ETRDCPLDCOEP73、(10分)用一片T4138三输入八输出译码器和适
6、当的与非门实现全减器的逻辑功能。S1S2S3T4138译码器A2A1A0Y0Y1Y2Y3Y4Y5Y6Y774138功能表:输入输出S1A2A1A0100000111111110001101111111001011011111100111110111110100111101111010111111011101101111110110111111111100φφφφ11111111φ1φφφ11111111五、(15分)单级放大电路如图6:在输入信号的中频段C1、C2、C3对交流短路,已知:VCC=12V、R1=150KΩ、R2=150KΩ、RC=5
7、.1KΩ、Re=2KΩ、RL=10KΩ、β=100、C1=C2=C3=10μF、VBE=0.7V、rbb’=200Ω,TC1C2C3R1R2RCReRLVOVi+————+VCC图6试求:(1)放大电路的Q点参数;(5分)(2)画出交流小信号等效电路,求的值;(5分)(3)若C2断开,将对Q点,产生何种影响?(5分)7六、判断题:(共15分)1、组合电路如图7-1所示:判断图7-1中电路的各晶体管T1、T2、T3分别构成何种组态的电路?(6分)2、请判断如图7-2电路中:(9分)(1)是否存在反馈?(2)若有,请判断有几条反馈通路?图7-1图7-
8、1(3)分别是什么反馈类型?对电路有什么影响?七、(共15分)单级放大电路如图8,在输入信号的中频段C1、C2、C足够大且对交流短路,试
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