由於intel於65奈米制程技术取得突破

由於intel於65奈米制程技术取得突破

ID:20034474

大小:36.50 KB

页数:4页

时间:2018-10-08

由於intel於65奈米制程技术取得突破_第1页
由於intel於65奈米制程技术取得突破_第2页
由於intel於65奈米制程技术取得突破_第3页
由於intel於65奈米制程技术取得突破_第4页
资源描述:

《由於intel於65奈米制程技术取得突破》由会员上传分享,免费在线阅读,更多相关内容在行业资料-天天文库

1、由於Intel於65奈米制程技術取得突破,因此其入門級處理器Pentium4及低階處理器CeleronD將會推出全新D0Stepping版本,由上代的FMB05A提升至FMB06規格,即TDP功耗表現不超過65W。將會被提升至D0-Stepping的入門級處理器包括型號Pentium4631(3.0GHz/2MBL2/800MHzFSB)、Pentium4641(3.2GHz/2MBL2/800MHzFSB)、Pentium4651(3.4GHz/2MBL2/800MHzFSB)及Pentium

2、4661(3.6GHz/2MBL2/800MHzFSB),低階處理器包括CeleronD356(3.46Ghz/512KBL2/533MHzFSB)及CeleronD360(3.46Ghz/512KBL2/533MHzFSB)。除了D0-Stepping的Pentium4及CeleronD是支援FMB06外,新一代IntelCore2Duo整個系列均為TDP65W,因此也被列為支援FMB06產品,而IntelCore2ExtremeX6800因功耗為75W,則被定為FMB05A的產品。據主機板業

3、者表示,現時Intel平台主機板供電模組規格分為FMB05A及FMB05B,其中代表產品TDP將不會超過95W及130W,但由於新一代的Core2Duo處理器整系列的TDP均為65W,因此有必要新增FMB06以識別該產品功耗並不超過65W,現時大部份主機板廠商在設計主機板供電模組是均按照FMB05B規格,因此新增FMB06並無需要對主機板供電模組設計作出更新。Intel第一代雙核心處理器設計只是單純地把兩顆核心封裝在一起,並分享同一個FrontSideBus(FSB)頻寬,當其中一顆核心使用FS

4、B時,另一顆便需要等待另一顆的完成才能使用FSB,加上IntelFSB設計是單向存取,還需要透過北橋來讀取系統記憶體資料,均嚴重加重Intel的FSB工作量,兩顆核心亦沒有直接溝通的橋樑,如果CPU0的L2Cache需要讀取CPU1的L2Cache,更是需要經過FSB及北橋才能達至出現嚴重的延遲。IntelCore微架構對此作出了大幅改良,全新的IntelAdvancedSmartCache有效加強多核心架構的效率,傳統的雙核心設計每個獨立的核心都有自己的L2Cache,但IntelCore微架

5、構則是透過核心內部的SharedBusRouter共用相同的L2Cache,當CPU1運算完畢後把結果存在L2Cache時,CPU0便可透過SharedBusRouter讀取CPU1放在共用L2Cache上資料,大幅減低讀取上的延遲並減少使用FSB頻寬,同時加入L2&DCUDataPre-fetchers及DeeperWriteoutput緩衝記憶體,大幅增加了Cache的命中率。相比現時K8的雙核心L2Cache架構,也是比不上AdvancedSmartCache設計,因為共用L2Cache能

6、進一步減少了CacheMisses的情況,K8微架構在CPU0需要讀取CPU1L2Cache的資料時,需要向SystemRequestInterface提向要求並透過CrossbarSwitch就把取讀資料,但CPU0發現讀取自己的L2Cache沒有該筆資料才會要求讀取CPU1的L2Cache資料,情況等同於CPU0的L3Cache,而共用的L2Cache設計卻沒有以上需要,AMD已明確在下一代K8L微架構中加入相似SharedCache技術,但K8L產品在AMDRoadmap中暫定於2007年

7、H2才能登場。SmartCache架構還有很多不同的好處,例如當兩顆核心工作量不平均時,如果獨立L2Cache的雙核心架構有機會出現其中一顆核心工作量過少,L2Cache沒有被有效地應用,但另一顆核心的L2Cache卻因工作量過重,L2Cache容量沒法應付而需要傳取系統記憶體,值得注意的是它並無法借用另一顆核心的L2Cache空間,但SmartCache因L2Cache是共用的而沒有這個問題。SharedBusRouter除了更有效處理L2Cache讀取外,還會為雙核心使用FSB傳輸進行排程,

8、新加入的BandwidthAdaptation機制改善了雙核心共用FSB時的效率,減少不必要的延遲,其實這個SharedBusRouter設計確實有點像K8的SystemRequestInterface及CrossbarSwitch的用途。此外,IntelAdvancedSmartCache架構用在行動處理器上亦很有優勢,系統工作量不高或是處於閒置狀態下,IntelCore微架構可以把其中一顆核心關掉,以減少處理器的功耗,不過卻可以保持4MBL2Cache保持工作,而且SharedBusRout

当前文档最多预览五页,下载文档查看全文

此文档下载收益归作者所有

当前文档最多预览五页,下载文档查看全文
温馨提示:
1. 部分包含数学公式或PPT动画的文件,查看预览时可能会显示错乱或异常,文件下载后无此问题,请放心下载。
2. 本文档由用户上传,版权归属用户,天天文库负责整理代发布。如果您对本文档版权有争议请及时联系客服。
3. 下载前请仔细阅读文档内容,确认文档内容符合您的需求后进行下载,若出现内容与标题不符可向本站投诉处理。
4. 下载文档时可能由于网络波动等原因无法下载或下载错误,付费完成后未能成功下载的用户请联系客服处理。