eda预习实验三报告new

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1、EDA预习实验三报告实验三、FPGA内部数字锁相环的使用一、实验目的1.利用quartues进行数字锁相环模块的调用。二、实验平台1、实验箱2、QUARTUSII三、实验内容及结果记录1、HDL程序(1)程序代码modulescan_led(clk_1k,d,dig,seg);//模块名scan_ledinputclk_1k;//输入时钟input[31:0]d;//输入要显示的数据output[7:0]dig;//数码管选择输出引脚output[7:0]seg;//数码管段输出引脚reg[7:0]seg_r;//定义数码管输出寄存器reg[

2、7:0]dig_r;//定义数码管选择输出寄存器reg[3:0]disp_dat;//定义显示数据寄存器reg[2:0]count;//定义计数寄存器assigndig=dig_r;//输出数码管选择assignseg=seg_r;//输出数码管译码结果always@(posedgeclk_1k)//定义上升沿触发进程begincount<=count+1'b1;endalways@(posedgeclk_1k)begincase(count)//选择扫描显示数据3'd0:disp_dat=d[31:28];//第一个数码管3'd1:disp

3、_dat=d[27:24];//第二个数码管3'd2:disp_dat=d[23:20];//第三个数码管3'd3:disp_dat=d[19:16];//第四个数码管3'd4:disp_dat=d[15:12];//第五个数码管3'd5:disp_dat=d[11:8];//第六个数码管3'd6:disp_dat=d[7:4];//第七个数码管3'd7:disp_dat=d[3:0];//第八个数码管endcasecase(count)//选择数码管显示位3'd0:dig_r=8'b01111111;//选择第一个数码管显示3'd1:dig

4、_r=8'b10111111;//选择第二个数码管显示3'd2:dig_r=8'b11011111;//选择第三个数码管显示3'd3:dig_r=8'b11101111;//选择第四个数码管显示3'd4:dig_r=8'b11110111;//选择第五个数码管显示3'd5:dig_r=8'b11111011;//选择第六个数码管显示3'd6:dig_r=8'b11111101;//选择第七个数码管显示3'd7:dig_r=8'b11111110;//选择第八个数码管显示endcaseendalways@(disp_dat)begincase(

5、disp_dat)//七段译码4'h0:seg_r=8'hc0;//显示04'h1:seg_r=8'hf9;//显示14'h2:seg_r=8'ha4;//显示24'h3:seg_r=8'hb0;//显示34'h4:seg_r=8'h99;//显示44'h5:seg_r=8'h92;//显示54'h6:seg_r=8'h82;//显示64'h7:seg_r=8'hf8;//显示74'h8:seg_r=8'h80;//显示84'h9:seg_r=8'h90;//显示94'ha:seg_r=8'h88;//显示a4'hb:seg_r=8'h83;

6、//显示b4'hc:seg_r=8'hc6;//显示c4'hd:seg_r=8'ha1;//显示d4'he:seg_r=8'h86;//显示e4'hf:seg_r=8'h8e;//显示fendcaseendendmodule2）实验结果记录实验完成后记录编译结果中的资源消耗、硬件仿真结果2、内容和步骤(1)实验内容:（宋体、小4号字）1.调用FPGA内部的数字锁相环模块，使其输出20M的频率。2.编写一个计数分频器，利用20M频率作为输入，输出一个周期为1S的方波，驱动LED闪烁。提示：计数分频器使用实验二的代码扩展CNT的位宽即可。(2)实

7、验步骤：1.根据提供的参考代码进行仿真验证。对参考代码进行详细的注释。2.记录编译、仿真、验证结果。输入时钟引脚选择clock0或clock1。3.扩展部分：利用已有模块，设计一款秒表。（7段数码管的动态扫描显示模块已经提供）具备如下功能：a)计时范围00-99S；b)具备暂停，开始，复位功能。