eda应用技术 章彬宏new

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1、EDA课设题目1：彩灯控制器设计一、彩灯控制器设计要求1.要有多种花型变化（至少设计4种）。2.多种花型可以自动变换，循环往复。3.彩灯变换的快慢节拍可以选择。4.具有清零开关。二、系统设计方案u根据系统设计要求可知，整个系统共有三个输入信号：控制彩灯节奏快慢的基准时钟信号(CLK)CLK_IN，系统清零信号CLR，彩灯节奏快慢选择开关SPEED_KEY；共有16个输出信号LED[15..0]，分别用于控制十六路彩灯。据此，我们可将整个彩灯控制器CDKZQ分为两大部分：时序控制电路SXKZ和显示控制电路XSKZ，整个系统的组成原理图如图7-1所

2、示。三、各模块VHDL源程序设计1.时序控制电路的VHDL源程序--SXKZ.VHDLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYSXKZISPORT(CHOSE_KEY:INSTD_LOGIC;CLK:INSTD_LOGIC;CLR:INSTD_LOGIC;CLK1:OUTSTD_LOGIC);ENDENTITYSXKZ;ARCHITECTUREARTOFSXKZISSIGNALTEMP_CLK:STD_LOGIC;BEGINPROCES

3、S(CLK,CLR,CHOSE_KEY)ISVARIABLETEMP:STD_LOGIC_VECTOR(2DOWNTO0);BEGINIFCLR='1'THEN--当CLR='1'时清零，否则正常工作TEMP_CLK<='0';TEMP:="000";ELSIFRISING_EDGE(CLK)THENIFCHOSE_KEY='1'THENIFTEMP="011"THENTEMP:="000";TEMP_CLK<=NOTTEMP_CLK;ELSETEMP:=TEMP+'1';ENDIF;---当CHOSE_KEY='1'时产生基准时钟频率的1/4

4、的时钟信号，否则产生基准时钟--频率的1/8的时钟信号ELSEIFTEMP="111"THENTEMP:="000";TEMP_CLK<=NOTTEMP_CLK;ELSETEMP:=TEMP+'1';ENDIF;ENDIF;ENDIF;ENDPROCESS;CLK1<=TEMP_CLK;ENDARCHITECTUREART;2.显示控制电路的VHDL源程序--XSKZ.VHDLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYXSKZISPORT(CLK1:INSTD_LOGIC;CLR:INSTD_LOG

5、IC;LED:OUTSTD_LOGIC_VECTOR(15DOWNTO0));ENDENTITYXSKZ;ARCHITECTUREARTOFXSKZISTYPESTATEIS(S0,S1,S2,S3,S4,S5,S6);SIGNALCURRENT_STATE:STATE;SIGNALFLOWER:STD_LOGIC_VECTOR(15DOWNTO0);BEGINPROCESS(CLR,CLK1)ISCONSTANTF1:STD_LOGIC_VECTOR(15DOWNTO0):="0001000100010001";CONSTANTF2:STD_

6、LOGIC_VECTOR(15DOWNTO0):="1010101010101010";CONSTANTF3:STD_LOGIC_VECTOR(15DOWNTO0):="0011001100110011";CONSTANTF4:STD_LOGIC_VECTOR(15DOWNTO0):="0100100100100100";CONSTANTF5:STD_LOGIC_VECTOR(15DOWNTO0):="1001010010100101";CONSTANTF6:STD_LOGIC_VECTOR(15DOWNTO0):="1101101101100

7、110";--六种花型的定义BEGINIFCLR='1'THENCURRENT_STATE<=S0;ELSIFRISING_EDGE(CLK1)THENCASECURRENT_STATEISWHENS0=>FLOWER<="ZZZZZZZZZZZZZZZZ";CURRENT_STATE<=S1;WHENS1=>FLOWER<=F1;CURRENT_STATE<=S2;WHENS2=>FLOWER<=F2;CURRENT_STATE<=S3;WHENS3=>FLOWER<=F3;CURRENT_STATE<=S4;WHENS4=>FLOWER<=

8、F4;CURRENT_STATE<=S5;WHENS5=>FLOWER<=F5;CURRENT_STATE<=S6;WHENS6=>FLOWER<=F