sopc_eda实验指导书

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1、EDA/SOPC实验指导书（含GW48-PK2SOPC/DSP实验开发系统详细使用说明）广东工业大学35目录第一章QuartusII使用指南第一节基于QuartusII的设计过程第二节QuartusII设计输入2.1、建立一个新项目2.2、图形输入方式2.3、文本输入方式2.4、第三方EDA工具输入方式第三节QuartusII编译3.1指定器件3.2引脚锁定3.3开始编译3.4编译报告3.5延时分析第四节QuartusII仿真第五节QuartusII编程下载第二章GW48SOPC系统(GW48-PK2)使用说明第一节GW48教学实验系统原理与使用介绍一、GW48系统使用注意事项二

2、、GW48系统主板结构与使用方法第二节实验电路结构图一、实验电路信号资源符号图说明二、各实验电路结构图特点与适用范围简述第三章用VerilogHDL设计数字电路【实验1】4选1多路选择器设计【实验2】8位硬件加法器设计【实验3】八位移位寄存器设计【实验4】移位相加8位硬件乘法器电路设计【实验5】任意模加法/减法计数器【实验6】六分频器的设计【实验7】交通灯控制系统【实验8】A/D采样控制电路设计35第一章QuartusII使用指南第一节基于QuartusII的设计过程使用QuartusII软件进行设计和开发的流程如图1.1所示，主要包括以下几个步骤：图1.1QuartusII开发

3、流程第二节QuartusII设计输入QuartusII软件的设计输入方法有很多种，具体如下：--QuartusII·原理图式图形设计输入·文本编辑--AHDL，VHDL，Verilog·内存编辑--Hex,Mif--第三方工具·EDIF·HDL·VQM--或采用一些别的方法去优化和提高输入的灵活性·混合设计格式·利用LPM和宏功能模块来加速设计输入35QuartusII的编译器能够接受多种输入文件格式，也能输出多种文件格式。图2.1给出了各种方式输入时所产生的文件格式。图2.1QuartusII的设计文件2.1、建立一个新项目QuartusII的编译器的工作对象是项目。因此，编译

4、项目前必须确定一个设计文件作为当前的项目。需要注意的是项目名必须与顶层设计文件名一致。具体建立步骤如图2.2所示。35图2.2项目的建立步骤352.2、图形输入方式用图形输入方式进行设计的一般流程为：1、产生一个新的模块设计文件--画出图表模块或输入设计单元符号--输入接口和参数信息--连接各个设计单元（利用单连线，总线等）2、保存设计--文件的后缀名为.bdf3、顶层设计可以产生设计单元，头文件，或转化成Verilog/VHDL文件具体步骤如图2.3所示35图2.3图形输入方式设计具体步骤2.3、文本输入方式QuartusII支持AHDL，VHDL及VerilogHDL等硬件描

5、述语言。采用进行文本设计的步骤如下：（1）定项目并建立新文件；（2）输入文本设计文件；（3）将文本文件命名、保存；（4）编译文件并检查、修改句法错误。首先选择File/New,在对话框中选择DeviceDesignFile,新建一个VerilogHDLFile无标题文本窗口，然后输入文件名保存。为了快速和准确地创建VerilogHDL文本文件，可以使用Verilog模板。选择Edit/Insert35Template/VerilogHDL，再选择ModuleDeclaration，点击OK按钮，这时就可以在对应的位置输入设计文件中的各项参数了，如图2.4所示。利用模板输入，可以避

6、免语法错误，提高输入效率。图2.4利用模板进行文本编辑2.4、第三方EDA工具输入方式35第一节QuartusII编译QuartusII编译器是由一系列处理模块构成的，这些模块负责对设计项目的检错，逻辑综合和结构综合。即将设计项目适配进FPGA/CPLD目标器中，同时产生多种用途的输出文件，如功能和时序仿真文件，器件编程的目标文件等。编译类型有如下几种：--只是综合并输出网表·编译设计文件，综合产生门级代码·编译器只运行到综合这步就停止了·编译器只产生估算的延时数值--完全的编译，包括编译，网表输出，综合，配置器件·编译器除了完成以上的步骤，还要将设计配置到ALTERA的器件中去

7、·编译器根据器件特性产生真正的延时时间和给器件的配置文件3.1指定器件在编译项目前，需要为设计项目指定一种器件，否则编译器会自动选择一种器件。选定器件的步骤如图3.1所示。35图3.1选择器件3.2引脚锁定选择菜单“Assignments“项中的”Assignpin..“,会出现如图3.2所示的对话框：图3.2引脚锁定353.3开始编译设置完各种配置选项后，即可以开始编译设计项目。如图3.3所示。在编译过程中，所有信息、错误和告警将会在自动打开的信息处理窗口中显示出来。如图3.4