4时序逻辑电路习题解答

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1、4时序逻辑电路习题解答98自我测验题1．图T4.1所示为由或非门构成的基本SR锁存器，输入S、R的约束条件是。A．SR=0B．SR=1C．S+R=0D．S+R=1图T4.1图T4.22．图T4.2所示为由与非门组成的基本SR锁存器，为使锁存器处于“置1”状态，其应为。A．=00B．=01C．=10D．=113．SR锁存器电路如图T4.3所示，已知X、Y波形，判断Q的波形应为A、B、C、D中的B。假定锁存器的初始状态为0。（a）(b)图T4.34．有一T触发器，在T=1时，加上时钟脉冲，则触发器。A．保持原态B．置0C．置1D．翻转5．假设JK触发器的现态Qn=0，要求Qn+1=0，则

2、应使。A．J=×，K=0B．J=0，K=×C．J=1，K=×D．J=K=16．电路如图T4.6所示。实现的电路是。4时序逻辑电路习题解答98A．B．C．D．图T4.67．电路如图T4.7所示。实现的电路是。A．B．C．D．图T4.78．电路如图T4.8所示。输出端Q所得波形的频率为CP信号二分频的电路为。A．B．C．D．图T4.89．将D触发器改造成T触发器，如图T4.9所示电路中的虚线框内应是。图T4.9A．或非门B．与非门C．异或门D．同或门10．触发器异步输入端的作用是。A．清0B．置1C．接收时钟脉冲D．清0或置111．米里型时序逻辑电路的输出是。A．只与输入有关4时序逻辑电

3、路习题解答98B．只与电路当前状态有关C．与输入和电路当前状态均有关D．与输入和电路当前状态均无关12．摩尔型时序逻辑电路的输出是。A．只与输入有关B．只与电路当前状态有关C．与输入和电路当前状态均有关D．与输入和电路当前状态均无关13．用n只触发器组成计数器，其最大计数模为。A．nB．2nC．n2D．2n14．一个5位的二进制加计数器，由00000状态开始，经过75个时钟脉冲后，此计数器的状态为：A．01011B．01100C．01010D．0011115．图T4.15所示为某计数器的时序图，由此可判定该计数器为。A．十进制计数器B．九进制计数器C．四进制计数器D．八进制计数器图T

4、4.1516．电路如图T4.16所示，假设电路中各触发器的当前状态Q2Q1Q0为100，请问在时钟作用下，触发器下一状态Q2Q1Q0为。图T4.16A．101B．100C．011D．00017．电路图T4.17所示。设电路中各触发器当前状态Q2Q1Q0为110，请问时钟CP4时序逻辑电路习题解答98作用下，触发器下一状态为。图T4.17A．101B．010C．110D．11118．电路如图T4.18所示，74LS191具有异步置数的逻辑功能的加减计数器，其功能表如表T4.18所示。已知电路的当前状态Q3Q2Q1Q0为1100，请问在时钟作用下，电路的下一状态Q3Q2Q1Q0为。图T4

5、.18A．1100B．1011C．1101D．0000表T4.1874LS191功能表CPD0D1D2D3Q0Q1Q2Q30×××d0d1d2d3d0d1d2d3100↑××××加法计数101↑××××减法计数11××××××保持19．下列功能的触发器中，不能构成移位寄存器。A．SR触发器B．JK触发器C．D触发器D．T和T＇触发器。20．图T4.20所示电路的功能为。4时序逻辑电路习题解答98图T4.22A．并行寄存器B．移位寄存器C．计数器D．序列信号发生器21．4位移位寄存器，现态Q0Q1Q2Q3为1100，经左移1位后其次态为。A．0011或1011B．1000或1001C．

6、1011或1110D．0011或111122．现欲将一个数据串延时4个CP的时间，则最简单的办法采用。A．4位并行寄存器B．4位移位寄存器C．4进制计数器D．4位加法器23．一个四位串行数据，输入四位移位寄存器，时钟脉冲频率为1kHz，经过可转换为4位并行数据输出。A．8msB．4msC．8µsD．4µs24．由3级触发器构成的环形和扭环形计数器的计数模值依次为。A．8和8B．6和3C．6和8D．3和6习题1．由或非门构成的基本SR锁存器如图P4.1所示，已知输入端S、R的电压波形，试画出与之对应的Q和的波形。图P4.1解：4时序逻辑电路习题解答982．由与非门构成的基本SR锁存器如

7、图P4.2所示，已知输入端、的电压波形，试画出与之对应的Q和的波形。图P4.2解：3．已知双门锁存器如图P4.3所示，试写出该锁存器的特性方程。图P4.3图P4.4解：先写出电路特性表。ABQnQn+1ABQnQn+10001100100111011010011014时序逻辑电路习题解答9801111111卡诺图4．写出图P4.4所示锁存器的特性方程解：CP=0时；RD=SD=0，Qn+1=QnCP=1时；，SD=S，5．钟控SR锁存器符号如图P4.5（a