乐曲硬件演奏电路的eda设计 曹圣洁

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1、乐曲硬件演奏电路的EDA设计摘要可编程逻辑器件（简称PLD）是一种由用户编程来实现某种逻辑功能的新型逻辑器件，主要包括FPGA和CPLD两大类。FPGA和CPLD分别是现场可编程门阵列和复杂可编程逻辑器件的简称。FPGA/CPLD最明显的特点是高集成度、高速度和高可靠性，其时钟延时可小至纳秒级，集合器并行工作方式，在超高速应用领域和实时测控方面有着非常广阔的应用前景。在高可靠领域，如果设计的得当，将不会存在类似于MCU的复位不可靠和PC的可能跑飞等问题。FPGA/CPLD的高可靠性还表现在几乎可将整个系统下载于同一芯片中，实现所谓的片上系统，从而大大的缩小的体积，易于管理和屏蔽。硬件的乐曲

2、演奏电路是用FPGA将50M时钟进行分频，两路的分频分别产生节拍和音调。随着时间的推移节拍计数信号会记录当前在乐谱中的位置，根据当前的位置会将音调控制的信号数组置成乐谱上的音调，挂载信号数组上面的音调发生器会产生相应的音调，其中为增加音乐的效果信号数组上挂载了一个8个LED控制器，不同的音调灯的亮灭的组合会各不同会产生看似随机的等组合实际灯亮的组合根据音调的确定是固定的。此现场可编程门阵列的程序是演奏生日快乐的乐曲的。下面会有他的乐谱。关键词FPGA，CPLD,乐曲演奏电路，音乐节拍发生器，音乐译码电路，可编程逻辑器件分频器。-19-乐曲硬件演奏电路的EDA设计AbstractProgra

3、mmablelogicdevices(hereinafterreferredtoasPLD)isakindofprogrammingbytheusertoachieveacertainlogicfunctionofthenewlogicdevices,includingtwokindsofFPGAandCPLD.FPGAandCPLDwerefieldprogrammablegatearrayandcomplexprogrammablelogicdevicereferredtoas.FPGA/CPLDthemostobviouscharacteristicishighintegration

4、,highspeedandhighreliability,theclocktimedelaycanbesmalltonanosecondlevel,collectorparallelworkway,intheultrahighspeedapplicationsandreal-timemeasurementandcontrolaspectshasaverybroadapplicationprospects.Inthefieldofhighreliability,ifthedesignisproper,therewillnotbesimilartotheMCUresetisnotreliabl

5、eandPCcanberunproblemssuchasfly.FPGA/CPLDhighreliabilityaswellasinalmostthewholesystemcanbedownloadfromthesamechip,soastorealizetheso-calledchipsystem,thusgreatlyreducedvolume,easytomanagementandshielding.ThemusicofhardwarecircuitisplayingwithFPGAwillfiftymclockforcrossover,two-waycrossoverrespect

6、ivelyproducerhythmandtone.Withthepassageoftimebeatcountsignalwillrecordthecurrentpositionofthemusic,accordingtothecurrentpositionwilltonecontrolsignalarraysettomusiconthetones,mountsignalarraythetonegeneratorcanproducecorrespondingtones,themusictoincreasetheeffectofarraysignalonmountaeightLEDcontr

7、oller,differenttoneslamplightoutofthedifferentcombinationwillcanproduceaseeminglyrandomcombinedtheactualcombinationoflightaccordingtodeterminethetoneisfixed.Thefieldprogrammablegatearrayprogramisplayingthemusicof