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时间:2018-06-14
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1、信息工程学院实验报告的内容与格式按任课教师的要求书写。数字逻辑与数字系统实验/实习报告学院:信息工程学院班级:信息111姓名:朱伟定学号:2011013259成绩:A实验六计数器及其应用一、实验目的1.学习集成触发器构成计数器的方法;2.掌握中规模集成计数器的使用方法及功能测试方法;3.用集成电路计数器构成1/N分频器。二、实验预习要求1.复习计数器电路工作原理;2.预习中规模集成电路计数器74LS192的逻辑功能及使用方法;3.复习实现任意进制计数的方法。三、实验原理 计数器是典型的时序逻辑电路,它用来累计和
2、记忆输入脉冲的个数。计数是数字系统中很重要的基本操作,集成计数器是最广泛应用的逻辑部件之一。 计数器种类较多,按构成计数器中的多触发器是否使用一个时钟脉冲源来分,有同步计数器和异步计数器;根据计数制的不同,分为二进制计数器、十进制计数器和任意进制计数器;根据计数的增减趋势,又分为加法、减法和可逆计数器。还有可预置数和可编程序功能计数器等。图实验6.1 四位二进制异步加法计数器 1.用D触发器构成异步二进制加/减计数器。 如图实验6.1所示,用四个D触发器构成四位二进制异步加法计数器,其连接特点是将D
3、触发器接成T’触发器,再由低位触发器的端和高一位的CP端相连。 如果将上图中的Q端与高一位的CP端相连,即可构成四位二进制异步减法计数器。 2.计数器级联使用及任意进制计数器的实现 (1)任意进制的实现 图实验6.2所示利用74LS192采用复位法构成五进制计数器。 图实验6.3所示利用74LS161采用置位法构成十进制计数器。图实验6.2复位法构成五进制计数器图实验6.3置位法构成十进制计数器 (2)一个十进制计数器只能表示0~9,要扩大计数范围,常常用多个十进制计数器级
4、联使用。74LS192设有进位(或借位)输出端,因此可用其进位(或借位)输出信号驱动下一级计数器。如图实验6.4所示。图实验6.4计数器扩展四、实验仪器设备1.TPE-ADⅡ数字电路实验箱1台2.双时钟同步加/减计数器74LS1922片3.四位同步二进制加法计数器74LS1611片4.双D触发器74LS742片5.四两输入集成与非门74LS001片五、实验内容及方法1.用74LS74D触发器构成四位二进制异步加法计数器。 (1)按图实验6.1连接,接至逻辑开关输出插孔,将CP端接单次脉冲源,输出端Q3、Q2、Q1、
5、Q0接逻辑电平显示插孔,接高电平+5V。 (2)清零后,逐个送入单次脉冲,观察并记录Q3、Q2、Q1、Q0状态。 (3)将单次脉冲改为1Hz的连续脉冲,观察Q3、Q2、Q1、Q0的状态。 (4)将CP改为1KHz,用示波器观察CP、Q3、Q2、Q1、Q0端波形。(5)将图实验6.1改成减法计数器,重复上述步骤,并列表记录输出状态。表1.1四位二进制异步加法计数器真值表CPQ3Q2Q1Q0CPQ3Q2Q1Q0000008100010001910012001010101030011111011401001211005
6、01011311016011014111070111151111表1.2将单脉冲改为连续脉冲后四位二进制异步加法计数器真值表CPQ3Q2Q1Q0CPQ3Q2Q1Q000000810001000191001200101010103001111101140100121100501011311016011014111070111151111表1.3四位二进制异步减法计数器CPQ3Q2Q1Q0CPQ3Q2Q1Q0011118011111110901102110110010131100110100410111200115101
7、013001061001140001710001500002.74LS192逻辑功能测试 将74LS192的CP接单脉冲源,清零端(CR=1)、置数端=0、数据输入端(D3~D0)分别接逻辑开关,输出端(Q3~Q0)接逻辑电平显示插孔;和接逻辑电平显示插孔或译码显示输入的相应插孔。按表6.1逐项测试,检查是否相符。表6.174LS192的功能表(1)清零(CR) 当CR=1,其它输入端状态为任意态,此时Q3Q2Q1Q0=0000。之后,置CR=0,清零结束。 (2)置数 当CR=0,CPu、C
8、PD任意,D3D2D1D0任给一组数据,=0时,输出Q3、Q2、Q1、Q0与D3、D2、D1、D0数据相同,此时74LS192处于置数状态。 (3)加法计数CR=0,LD=CPD=1,CPu接单次脉冲源。在清零后送入9个单次脉冲,观察输出状态变化是否发生在CPu的上升沿。CPQ3Q2Q1Q0CPQ3Q2Q1Q000000501011000
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