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时间:2020-03-03
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1、逻辑图式)>(、逻辑一、填空题:(每空3分,共15分)1.逻辑函数有四种表示方法,它们分别是(表达)和(、卡诺图2.将2004个T异或起來得到的结果是()。3.由555定时器构成的三种电路中,()是脉冲的整形电路。4.TTL器件输入脚悬空相当于输入()电平。5.基木逻辑运算有:()、()运算。6.采用四位比较器对两个四位数比较时,先比较()位。7.触发器按动作特点可分为基本型、()和边沿型;8•如果要把一宽脉冲变换为窄脉冲应采用(触发器9.目前我们所学的双极型集成电路和单极型集成电路的典型电路分别是
2、()电蹄1()电路010.施密特触发器有()个稳定状态.,多谐振荡器有()个稳定状态。11.数字系统按组成方式可分为、两种;12.两二进制数相加时,不考虑低位的进位信号是()加器。13.不仅考虑两个相加,而II还考虑来自相加的运算电路,称为全加器。14.时序逻辑电路的输出不仅和有关,而且还与—一有关。15.计数器按CP脉冲的输入方式可分为和-16.触发器根据逻辑功能的不同,可分为、、、、等。17.根据不同需要,在集成计数器芯片的基础上,通过采用、、__等方法可以实现任意进制的技术器。18.4.一个J
3、K触发器有个稳态,它可存储位二进制数。19.若将一个止弦波电压信号转换成同一频率的矩形波,应采用电路。20.把JK触发器改成T触发器的方法是o21.N个触发器组成的计数器最多可以纽•成进制的计数器。22.基本RS触发器的约束条件是。9.对于JK触发器,若J=K,则可完成T触发器的逻辑功能:若J=K,则可完成D触发器的逻辑功能n%1.数制转换(5分):1、(11.001)2=()16=()2、(8F.FF)16=()2=()103、(25.7)1o=()2=()164、(+1011B)原同=()反阳=
4、()补网5>(—101010B)原码=()反码=()补玛%1.函数化简题:(5分)1、化简等式Y=ABC+ABC+ABCY=~AB+AC+BCY=CD(A㊉B)+刁+给定约束条件为:AB+CD=02用卡诺图化简函数为最简单的与或式(画图)。丫=工加(0,2,8,10)1.试画出下列触发器的输出波形(设触发器的初态为0).(12分)1.CP▲I口口口口■012.ACP—JQ-O>_KQDQ2Hnnnn,03ACPQ32.已知输入信号X,Y,Z的波形如图3所示,试画出F=XYZ+XYZ+XYZ+XYZ的
5、波形nxn__vnrnzJ图3波形图%1.分析题(30分)1、分析如图所示纽•合逻辑电路的功能。Y-o2.试分析如图3所示的纽.合逻辑电路。(15分)1).写出输出逻辑表达式;2).化为最简与或式;3).列出真值表;4).说明逻辑功能。图33.七、分析如下时序电路的逻辑功能,写出电路的驱动方程、状态方程和输出方程,画岀电路的状态转换图。(20)计数脉冲CP4.74161组成的电路如题37图所示,分析电路,并回答以下问题(1)画岀电路的状态转换图(QsQQQ。);(2)说出电路的功能。(74161的功
6、能见表)©74161YLDnnDUDIQ0-D201-D3Q2-EPQ3-ETC-YRDCPTCOUNTERCPRdLDEPET工作状态X0XXX置零R10XX预置数X1101保持X11X0保持(但00)R1111计数74161功能表题37图六.设计题:(30分)1.要求用与非门设计一个三人表决用的纟I[合逻辑电路图,只要有2票或3票同意,表决就通过(要求有真值表等)。2.试用JK触发器和门电路设计一个十三进制的计数器,并检查设计的电路能否自启动。(14分)七.(10分)试说明如图5所示的用555定
7、时器构成的电路功能,求出UT+、UT-和AUT,并画出其输出波形。(10分)Voh答案:%1.填空题1.真值表、逻辑图、逻辑农达式、卡诺图;2.0;高与最同••••45673.施密特触发器、取稳态触发器、或、非、主从型;8.积分型单稳态9.TTL、CMOS;10.两、0;11.功能扩展电路、功能综合电路;12.半13.本位(低位),低位进位14.该时刻输入变量的収值,该时刻电路所处的状态15.同步计数器,异步计数器16.RS触发器,T触发器,JK触发器,T"触发器,D触发器17.反馈归零法,预置数法
8、,进位输出置最小数法18.两,一19.多谐振荡器20.J=K=T21.2n22.RS=0二.数制转换(10):1.(11.001)2=(3.2)16=(3.125)102>(8F.FF),6=(10001111.11111111)2=(143.9960937)“3、(25.7))0=(11001.1011)2=(19.B)“4、(+1011B)區码=(01011)反码=(01011)补狷5>(-101010B)原码=(1010101)反码=(1010110)补码%1.
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