VHDL语言带同步置位、复位的D触发器.doc

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1、VHDL语言编写的带同步置位/复位的D触发器：libraryieee;useieee.std_logic_1164.all;useieee.std_logic_unsigned.all;entitytrigger_disport(clk,d,sreset,sset:instd_logic;--同步复位端sreset，同步置位端ssetq,qf:outstd_logic);endentity;architectureartoftrigger_disbeginprocess(clk,d,sreset,sset)beginifclk'eventandcl

2、k='1'thenifsreset='1'thenq<='0';qf<='1';--同步复位端sreset，高电平有效，复位elsifsset='1'thenq<='1';qf<='0';--同步置位端sset，高电平有效，置位elseq<=d;qf<=not(d);endif;endif;endprocess;endarchitectureart;