数电试题第五套

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1、《数字电子技术》考试试卷（第五套）填空题（共30分）1、（2分）已知带符号二进制数A=（+1011000）”则该数用原码表示为A沪01011000,反码表示为A反二01011000。2、（2分）（76）n=（1001100）B=（4C）h。3、（2分）三态门可能输出的三种状态是低电平、高电平和高阻态一。4、（2分）在如图所示OD门构成的电路中，输出函数Z二巫C。A—&B—QA-z5、（4分）下图所示逻辑屯路的输出逻辑函数表达式F二亦+BC+広C。6、（3分）8选1数据选择器74HC151各输入端信号如下图所示，其输出F=0010111021001234567ESSSDDDDDDDD74HC15

2、1LZ7、（3分）8位倒T型电阻网络D/A转换器，当电路输入的数字量为80H时，输出电压v0=4V,则当输入的数字量为110000时,输出电压vo=1.5Vo8、（3分）A/D转换器一般要经过取样、保持、量化和编码这4个转换过程,取样时要满足取样定理，即fs>2fimaxo9、（4分）实现两个二位二进制相加的加法器，所需ROM的容量至少为48,该ROM有4条地址线,3条数据线。10、（3分）一个存储容量为4KX4的存储器有2“个存储单元,若用该存储器构成32KX8的存储系统，则需16片4KX4的存储器。11、（2分）用n个触发器组成的计数器，其最大计数模是2"。用卡诺图法将下列逻辑函数化简为最

3、简与或式（10分）F=ABCD+ABD+BCD+BC解：最简与或式F=AB+BC+BD三、（6分）时序电路及输入波形如图所示，写出其激励方程和状态方程，并画出输出Q端的波形。设触发器初态为“0”。CPIDQ>C1>—Q1I.IIIIII1IIIIIIII解：激励方程D=Q状态方程2o+l=QHQ端的波形如上图所示。四.（16分）设计一个三输入的组合逻辑电路，当输入的二进制码小于5时，输出为0,大于等于5时，输出为1。要求:（1）列出真值表;（2）写出逻辑函数的最简与或式（3）用非门和与非门实现该电路;（4）用74HC138实现该电路。解：（1）真值表:设输入A、B、C,输出FABCF00000

4、010010001101000101111011111（2）逻辑函数的最简与或式;F=ABC+ABC+ABC=AB+AC（3）用非门和与非门实现F=AB+AC=ABAC用非门和与非门实现该电路的逻辑图如下图（a）所示（4）用74HC138实现A、B、C从A?、A】、A（）输入，令耳=1卫2二E=0F=ABC+ABC+ABC=m5+m6+®=m5•加§•®=E•E%用74HC138实现该电路的逻辑图见下图(b)图（a）ABCrb5VABC+E3Y0E2Y1ElY2Y374HC138¥4A2Y5AlY6AOY7&图（b）五、（20分）分析下图所示的时序逻辑电路，写出其激励方程、状态方程和输出方程，

5、画出其状态转换表、状态转换图，并说明电路实现的逻辑功能。CP解：激励方程Jo=K（）=lJi=K]=A㊉Q（）输出方程Z=状态方程er1=㊉©㊉©状态转换表状态转换图00/ZA=0A=10001/111/00110/000/01011/001/01100/010/1功能：该电路是一个同步可逆2位二进制（模4）计数器。人=0时，加计数，Z上升沿触发进位，A=1时，减计数器，Z下降沿触发借位。六.（10分）4位同步二进制加法计数器74LVC161构成如图所示电路。试分析该电路，画出它的状态图，说明它是多少进制计数器。解：电路在2200=1101时产生零信号，使异步清零端探为零。故该电路为用74HT

6、C161构成的同步十三进制计数器，其状态图如下图所示。七、（8分）请绘制由555定时器构成的施密特触发器的电路图。若输入Ui的波形如下图所示，又知Vcc=15V,5脚不外加控制电压。求正向闕值电压Vt+,负向闕值电压并画出该电路输出Uo的波形。555定时器的符号—6555'个525I“>vr+=

7、vcc=iov解：；Vr-=

8、VCC=5V555定时器构成的施密特触发器的屯路及输出Uo的波形如下图。Vex附表附表1：集成数据选择器74HC151的功能表输入输出使能E选择S2SISOYYHXXXLHLLLLDODOLLLHDIoiLLHLD2D2LLHHD3D3LHLLD4D4LHLHD5D5LH

9、HLD6D6LHHHD7D7输入输出E3E2EiA2AiAoy（）YiYir3YaYsY6YiXHXXXXHHHHHHHHXXHXXXHHHHHHHHLXXXXXHHHHHHHHHLLLLLLHHHHHHHHLLLLHHLHHHHHHHLLLHLHHLHHHHHHLLLHHHHHLHHHHHLLHLLHHHHLHHHHLLHLHHHHHHLHHHLLHHLHHHHHHLHHLLHHHHHHHHHH