期末试卷三答案

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1、本科生期末试卷三答案一.选择题1B2B3D4C5A6C7C8C9B10B二.填空题1.A.CPUB.CPUC.主机2.A.原码B.补码C.反码3.A.SRAMB.DRAMC.集程度4.A.指令寻址B.顺序C.跳跃5.A.存储器B.指令周期C.不相同的6.A.ISAB.EISAC.VISA7.A.VGAB.1280X1024C.24位8.A.嵌套B.优先级高C.优先级地所以:[・x]补=0.01111三.解:[x]原=1.01111[x]补二1.10001[y]原=0.11001[y]补=0.11001[x]补11.10001+[y]补00.11001""[x+y]补00.01010

2、所以:x+y=+0.01010所以:[・y]补=1.00111[x]补11.10001+[・y]补11.00111[x-y]补10.11000因为符号位和异,结果发牛溢出四.解:由已知条件,机器字长16位,主存容量128KB/2二64KB字,因此MAR二18位,共128条指令,故0P字段占7位。采用单字长和双字长两种指令格式,其屮单字长指令用于算术逻辑和I/0类指令,双字长用于访问主存的指令。OPR,R.15954320159865320OPXR2D寻址方式由寻址模式X定义如下:x=ooo直接寻址E=D(64K)X=001立即数D=操作数X=010相对寻址E二PC+DPC二16位X

3、=011基值寻址E=Rb+D,Rb=16位X=100问接寻址E=(D)X=101变址寻址E=Rx+D,Rx=10位五.解:可采用多体交叉存取方案,即将主存分成8个相互独立、容量相同的模块M(),M

4、,M2,・・・M7,每个模块32MX32位。它各自具备一套地址寄存器、数据缓冲寄存器,各口以同等的方式与CPU传递信息,其组成结构如图B3.3:图B3.3CPU访问8个存贮模块,可釆用两种方式:一种是在一个存取周期内,同吋访问8个存贮模块,由存贮器控制它们分时使用总线进行信息传递。另一种方式是:在存取周期内分时访问每个体,即经过1/8存取周期就访问一个模块。这样,对每个模块而言,从CPU

5、给出访存操作命令直到读出信息,仍然是一个存取周期时间。而对CPU来说,它可以在一个存取周期内连续访问8个存贮体,各体的读写过程将重叠进行。三.解:加法指令“ADDX(Ri)"是一•条隐含指令,其中一个操作数来自AC。,另一个操作数在数据存贮器屮,地址市通用寄存器的内容(R)加上指令格式屮的X量值决定,町认为这是一种变址寻址。因此,指令周期的操作流程图如图B3.4:相应的微操作控制信号列在框图外。PC-^IARIPC-..IARi»IM—IDRIifcIM.IDRieIIDR—IR[iDRx..IRle

6、/fg—IRQ入JfACt]K*•»<•Xi•+•ACt»oAClDAR]AC—

7、.DARiaDM—DDRIitDM.DDRieI―ACojBUsj.+图B3・4三.解:分五个阶段:请求总线,总线仲裁,寻址(目的地址),信息传送,状态返回(错启动信号读命令一'地址线—地址〉-—■■—・・・—数据线—认可11—图B3.5四.解:该中断系统可以实行5重中断,中断优先级的顺序是,优先权1最高,主程序运行于最低优先权(优先权为6)。图B3.2中岀现了4重中断。图B3.2中中断过程如下:主程序运行到T]时刻,响应优先权4的中断源的中断请求并进行中断服务;到T?时刻,优先权4的屮断服务还未结束,但乂出现了优先权3的中断源的屮断请求;暂停优先权4的屮断服务,而响应优先权3的中

8、断。到Tq时刻,又被优先权2的中断源所中断,直到T6时刻,返回优先权3的服务程序,到T?时刻,又被优先权1的中断源所中断,到%时刻,优先权1的中断服务完毕,返回优先权3的服务程序,冑到Tg优先权3的中断服务结束,返回优先权4的服务程序,优先权4的服务程序到J结束,最厉返冋主程序。图B3.2中,优先权3的服务程序被屮断2次,而优先权5的屮断乂产生。

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