电工学-第13章时序逻辑电路

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1、第13章时序逻辑电路13.1基本双稳态触发器13.2钟控双稳态触发器13.3寄存器13.4计数器13.5集成定时器下一章上一章返回主页双稳态触发器：由门电路加上适当的反馈而构成的一种新的逻辑部件。双稳态触发器与门电路区别：双稳态触发器输出电平的高低不仅取决于当时的输入，还与以前的输出状态有关，是有记忆功能的逻辑部件。13.1基本双稳态触发器2大连理工大学电气工程系逻辑状态相反触发器的状态：Q=1Q=0Q=1Q=0规定:Q端的状态为触发器的状态。一、输入为低电平有效的基本RS触发器复位状态置位状态1.电路QQRS&12&3大连理工大学电气工程系0101010111011000Q

2、nQn+1SR012.逻辑功能QnQQRS&12&11保持原态4大连理工大学电气工程系00：直接置0端直接复位端R0101010111011000QnQn+1SRQn0QQRS&12&10置0015大连理工大学电气工程系11：直接置1端直接置位端S0101010111011000QnQn+1SRQn01QQRS&12&01置1106大连理工大学电气工程系11负脉冲有效0101010111011000QnQn+1SRQn01不定QQRS&12&00不定117大连理工大学电气工程系RSQn+100不定01010111Qn3.真值表4.逻辑符号R和S端部各加一个小圆圈，表示输入信号

3、为低电平有效。QQRS8大连理工大学电气工程系二、输入为高电平有效的基本RS触发器1.电路RSQn+100Qn01110011不定2.真值表3.逻辑符号R和S端部不加一个小圆圈，表示输入信号为高电平有效。QQRSRSQQ1≥12≥19大连理工大学电气工程系一、RS触发器1.电路结构四门钟控型电路结构门1、2组成基本RS触发器，门3、4组成导引电路。13.2钟控双稳态触发器时钟脉冲：指挥各触发器动作的信号。钟控触发器：又称同步触发器。按逻辑功能分类：RS触发器、JK触发器、D触发器、T触发器。QQRDSDSRCPS′R′1&&&&23410大连理工大学电气工程系2.逻辑功能(1

4、)CP=0时011导引门3、4被封锁。触发器保持原态：Qn+1=Qn设置初态为1设置初态为0QQRDSDSRCPS′R′1&&&&23411大连理工大学电气工程系QQRDSDSRCPS′R′1&&&&2341(2)CP=1时导引门3、4打开，接收R、S的信号。RSQn+1000110110011Qn保持原态12大连理工大学电气工程系QQRDSDSRCPS′R′1&&&&2341(2)CP=1时导引门3、4打开，接收R、S的信号。RSQn+1000110111001Qn10113大连理工大学电气工程系QQRDSDSRCPS′R′1&&&&2341(2)CP=1时导引门3、4打开

5、，接收R、S的信号。RSQn+1000110110110Qn011014大连理工大学电气工程系1(2)CP=1时导引门3、4打开，接收R、S的信号。RSQn+1000110111100Qn1110不定QQRDSDSRCPS′R′1&&&&23415大连理工大学电气工程系3.触发方式电平触发方式CP＝1接受信号，并立即输出相应信号：高电平触发CP＝0接受信号，并立即输出相应信号：低电平触发高电平触发SDQQ1SC11RRDSRCP低电平触发SDQQ1SC11RRDSRCP16大连理工大学电气工程系[例13.2.1]已知高电平触发RS触发器，R和S端的输入波形如图所示，而且已知触

6、发器原为0态，求输出端Q的波形。RSCP1234Q多次翻转[解]17大连理工大学电气工程系二、JK触发器1.电路结构S=JQnR=KQn主从型电路结构从触发器的输出状态由主触发器的状态决定主触发器JKRDCP1SC11RSDQQ1SC11R从触发器CP：0→1主触发器打开—接受信号从触发器关闭—输出状态不变CP：1→0主触发器关闭—不接受信号从触发器打开—输出相应状态18大连理工大学电气工程系2.逻辑功能JKQn+100011011QnQQ主触发器JKRDCP1SC11RSDQQ1SC11R从触发器10000保持不变S=JQnR=KQn19大连理工大学电气工程系2.逻辑功

7、能JKQn+100011011QnQQ主触发器JKRDCP1SC11RSDQQ1SC11R从触发器01010101S=JQnR=KQn20大连理工大学电气工程系2.逻辑功能JKQn+100011011QnQQ主触发器JKRDCP1SC11RSDQQ1SC11R从触发器01101010S=JQnR=KQn121大连理工大学电气工程系2.逻辑功能JKQn+100011011QnQQ主触发器JKRDCP1SC11RSDQQ1SC11R从触发器011110原态：01S=JQnR=KQn1新态：102