arm硬件设计系列(4部分)

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1、ARM硬件设计一——电源和时钟电源问题1.VDDCORE和VDDIO引脚电源A)VDDCORE和VDDIO引脚电源必须连接到使用退耦电容的干净的直流电源上；退耦电容应尽可能的接近微控制器的VDD和GND引脚；退耦电容典型值是33nF到100nF。B)除保证复位的延时时间大于两个电源的上升时间外，对电源的时序上没有特殊的要求。C)值得注意的是在VDDCORE一直给微控制器供电保存内部RAM和寄存器内容时VDDIO供电不能停止，如果这样的话他不是破坏性的，带能导致内部外围设备的输入进入一个不确定的状态。此外，

2、除电流连续状态下的阻性负载外，VDDIO的电流消耗依赖于连接到EBI的I/O线和PIO线切换时的负载电容。这就是说，当CPU处于备用状态时不需要停止VDDIO.2.VPP引脚VPP用来提高FLASH的编程和擦除速度。电压范围参见数据手册。VPP引脚可以不连接，为防止意外，可以考虑施加一个已知的电平以防止步必要的动作。主时钟引脚1.MCKI引脚MCKI引脚是微控制器的主时钟输入引脚。此引脚输入一个方波时钟信号。外部时钟的高半周期（tCH)和低半周期(tCL)有一个最小值，见数据手册。AT91X40X系列没有

3、内部振荡器，仅仅连接一个晶振是不可以的。2.MCKO引脚MCKO引脚提供一个延时的MCKI引脚的时钟输入信号的镜像以提供系统内的其他设备使用。MCKO驱动能力低，用它来驱动几个TTL负载是不可行的。当使用BGA封装的AT91X40X系列微控制器时，如果这个引脚不使用，强烈建议你将它作为PCB上的测试点。这样用来快速判断微控制器是否有一个正确的时钟ARM硬件设计二——复位引脚和复位期间采样引脚NRST输入引脚NRST引脚用于主系统复位。它为低时复位所有内部设备寄存器，ARM内核的程序计数器和JTAG/ICE

4、端口。在系统引导时他采样BMS和NTRI引脚。NRST必须被保持到提供给微控制器的电源稳定和依照外部振荡器的启动时间。在释放NRST引脚前必须保持0电平至少10个时钟周期以便能够正确的采样BMS和NTRI引脚。复位期间采样的引脚1.引导模式选择引脚(BMS)P25/BMS输入引脚在NRST引脚的上升沿采样。这个引脚使ARM7TDMI内核从他的内部闪存，或连接到EBI的片选0(NCS0)的一个或多个闪存开始读取指令。一旦BMS引脚在复位期间被采样完毕并且处理器正确初始化，P25/BMS引脚能够作为通用I/O

5、引脚。依赖于BMS引脚的电平，能够选择引导用存储器数据总线宽度的选择，8位或16位。具体请参见数据手册。2.三态输入引脚为了调试的方便，AT91X40X系列提供了一个三态模式。这能够从目标板连接仿真探头到应用板。在三态模式，所有AT91X40X系列微控制器的输出驱动引脚均被禁止。对于基于闪存的AT91FR40X系列微控制器，三态模式使编程器像对待ATMEL闪存一样对待微控制器。当用户不使用AT91系列的三态模式时，在复位期间NTRI引脚必须通过一个400KR的电阻上拉。注意，NTRI引脚复用为I/O线P2

6、1和USART1的TXD1引脚。如果此引脚连接到一个内部包含400KR电阻的标准RS232驱动器，则不需要上拉电阻。详细参见RS232驱动器。ARM硬件设计三——JTAG引脚和PIO引脚JTAG/ICE端口引脚在带IEEE1149标准的JTAG/ICE端口的任何ARM处理器中，TDI,TDO,TMS和TCK是最少的引脚。除TDO引脚外的其他所有引脚内部均有大约10KR的上拉电阻。这些引脚用来访问ARM内核的ICE以进行调试。ATX40X系列在数字I/O单元不具有边界扫描特性，因此在此系列中JTAG的边界扫

7、描特性不能使用。PIO引脚1.复用引脚大多数的I/O引脚复用为一个或两个内部设备。这些引脚的大多数在PIO模式重新安排状态，举例来说，对于P21/TXD/NTR1示例来说，不受内部设备驱动。其他一些引脚像地址线A20-A23在外围模式有他们自己的安排状态，举例来说，受EBI驱动。如果这些引脚复位后由不由外围设备驱动，他们作为通用I/O引脚。未使用的引脚不用连接但为了避免一些外部异常信号导致的不必要行为和/或内部震荡导致的额外电流损耗，通常考虑在初始化代码中设置这些未使用的引脚为输出模式。这些I/O线在嵌入

8、式微控制器中没有上拉或下拉电阻。2.单一功能的PIO引脚单一功能的PIO引脚不和任何内部设备复用的I/O引脚。缺省状态，所有I/O引脚在复位后在输入模式。未使用的I/O引脚可以不连接，但要在初始化代码中设置为输出模式。这些I/O线在嵌入式微控制器中没有上拉或下拉电阻ARM硬件设计四——EBI总线 1.地址线引脚AT91X40X系列地址总线有24根地址线并且因此能够访问16M的存储器空间。地址线A0-A23不能和任何PIO线或内