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时间:2018-07-10
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1、郑州科技学院EDA(电子设计自动化)设计报告题目汽车尾灯控制器学生姓名专业班级学号所在系任课教师完成时间目录1.设计的目的12.设计的内容及要求12.1设计内容12.2设计要求13.整体方案设计14.单元模块设计24.1八分频电路24.2左右控制电路24.3主控电路35.模块的功能设计与仿真45.1八分频电路45.2左右控制电路55.3主控电路86.心得体会107.参考文献111.设计的目的本次设计的目的就是通过实践深入理解状态机原理,了解EDA技术并掌握VHDL硬件描述语言的设计方法和思想。通过学习的VHDL语言结合电子电路的设计知识理论联系实际,掌握所学的课程知识和基本单元电路
2、的综合设计应用。通过对实用汽车尾灯控制器的设计,巩固和综合运用所学知识,提高分析、解决EDA技术实际问题的独立工作能力。2.设计的内容及要求2.1设计内容设计一个汽车尾灯控制器,利用EDA软件(MAX+plusII)进行编译及仿真,设计输入可采用VerilogHDL硬件描述语言输入法和原理图输入2.2设计要求利用VerilongHDL语言和FPGA器件实现下述功能:(1)汽车正常行驶时指示灯都不亮。(2)汽车转弯时,对应侧的转弯灯亮。(3)汽车刹车时,两侧的刹车灯亮。(4)汽车在夜间或大雾天行驶时,两侧雾灯一直亮3.整体方案设计当汽车正常行驶时所有指示灯都不亮;当汽车向右转弯时,汽
3、车右侧的转弯灯right亮;当汽车向左侧转弯时,汽车左侧的转弯灯left亮;当汽车刹车时,汽车右侧的刹车灯brake_led和汽车左侧的刹车灯brake_led同时亮;当汽车在夜间或者大雾天行驶时,汽车右侧的雾灯lednight1和汽车左侧的雾灯lednight2同时一直亮。通过设置系统的输入信号:系统时钟信号clk,汽车左转弯控制信号left,汽车右转弯控制信号right,刹车信号brake,夜间行驶或者雾灯信号nf;系统的输出信号:汽车左侧3盏指示灯ledleft,1edbrake1,1ednight1和汽车右侧3盏指示灯ledright,ledbrake2,lednight2
4、实现以上功能。10汽车行驶信号主控模块左灯控制模块右灯控制模块显示时钟2-1系统设计整体框图4.单元模块设计4.1八分频电路2-2八分频电路图功能:该模块功能是以CLKRST为输入信号,CP为输出信号,实现对CLK的八分频CLK:时钟信号;RST:复位信号;CP:八分频输出信号;4.2左右控制电路103-1左右控制电路图CLK:时钟控制信号;LP:左侧灯控制信号;RR:右侧灯控制信号;BRAKE_LED:刹车控制信号;NIGHT_LED:夜间行驶控制信号;功能:该模块用于控制左、右两侧灯的亮、灭和闪烁情况,当时钟上升沿信号和左右两侧灯控制信号或刹车控制信号或夜间行驶信号同时出现时,
5、相应侧的灯亮或出现闪烁。4.3主控电路3-2主控制电路图RIGHT:右转信号;LEFT:左转信号;BRAKE:刹车信号;NIGHT:夜间行驶信号;LP:左侧灯控制信号;RP:右侧灯控制信号;10LR:错误控制信号;BRAKE_LED:刹车控制信号;NIGHT_LED:夜间行驶控制信功能:该模块用于对汽车尾灯进行整体控制,当输入为左转信号时,输出左侧灯控制信号;当输入为右转信号时,输出右侧灯控制信号;当同时输入LEFT和RIGHT信号时,输出错误控制信号。当输入为刹车信号时,输出刹车控制信号;当输入为夜间行驶信号时,输出为夜间行驶控制信号。5.模块的功能设计与仿真6.5.1八分频电路
6、程序:modulecounter8(clk,rst,clp);inputclk;inputrst;outputcp;regcp;reg[3:0]count;prameterN=8;always@(posedgeclk)beginif(!rst)begincount<=1’60;cp=<1’60;endelseif(count7、:modulezuoyoukongzhi(CP,RP,LR,BRAKE_LED,NIGHT_LED,LEDR,LEDB,LEDN);inputCP,RP,LR,BRAKE_LED,NIGHT_LED;outputLEDR,LEDB,LEDN;regLEDR,LEDB,LEDN;10reg[1:0]t;always@(posedgecp)beginif(RP==1)t=++1;elseif(RP=0);end;always@(t)if(RP==1)begincaseif
7、:modulezuoyoukongzhi(CP,RP,LR,BRAKE_LED,NIGHT_LED,LEDR,LEDB,LEDN);inputCP,RP,LR,BRAKE_LED,NIGHT_LED;outputLEDR,LEDB,LEDN;regLEDR,LEDB,LEDN;10reg[1:0]t;always@(posedgecp)beginif(RP==1)t=++1;elseif(RP=0);end;always@(t)if(RP==1)begincaseif
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