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时间:2018-01-27
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1、本科学生毕业论文(设计)题目(中文):基于VerilogHDL的浮点运算器的研究与设计(英文):TheResearchandDesignofFloating-pointArithmeticUnitsBasedontheVerilogHDL姓名学号院(系)电子工程系专业、年级电子信息工程级指导教师II湖南科技学院本科毕业论文(设计)诚信声明本人郑重声明:所呈交的本科毕业论文(设计),是本人在指导老师的指导下,独立进行研究工作所取得的成果,成果不存在知识产权争议,除文中已经注明引用的内容外,本论文不含任何其他个人或集体已经发
2、表或撰写过的作品成果。对本文的研究做出重要贡献的个人和集体均已在文中以明确方式标明。本人完全意识到本声明的法律结果由本人承担。本科毕业论文(设计)作者签名:年月日34毕业论文(设计)任务书课题名称:基于VerilogHDL的浮点运算器的研究与设计学生姓名:系别:电子工程系专业:电子信息工程指导教师:34湖南科技学院本科毕业论文(设计)任务书1、主题词、关键词:浮点运算器浮点数规格化VerilogHDL模块化设计2、毕业论文(设计)内容要求:(1)熟悉浮点数运算器的结构和原理,采用硬件描述语言设计各功能模块;(2)运用Ve
3、rilog语言编程来实现浮点数的加、减、乘、除法基本运算功能;(3)实现各运算功能模块在QuartusⅡ9.0上的仿真波形图;(4)分析可能存在的影响运算器速率和精度问题,修改并调试源程序;(5)研究并改进浮点运算器的运算精度和速率;(6)研究并统计实际结果进行验证、分析总结。343、文献查阅指引:[1]李澄举.基于IEEE754浮点数的快速反码加法器设计[J].嘉应学院,2010,6(2),4.[2]王伟.VerilogHDL程序设计与应用[M].北京:人民邮电出版社,2005:25-30.[3]周宁宁.基于FPGA技
4、术的浮点运算器的设计与实现[J].计算机工程与设计,2005,26(6),24.[4]刘瑞新,胡健,高明远.VHDL语言与FPGA设计[M].机械工业出版社,2004:48-52.[5]刘绍汗,林灶生,刘新民.VHDL芯片设计[M].清华大学出版社,2004:90-95.[6]潘松,黄继业.EDA技术与VHDL[M].北京:清华大学出版社,2007:80-86.[7]乔庐峰.VerilogHDL数字系统设计与验证[M].北京:电子出版社,2009:105-120.[8]王晓莉.高速流水线浮点加法器的FPGA实现[J].电
5、子元器件应用,2010,11(4),8.[9]梁峰,邵志标,孙海珺.43位浮点流水线乘法器的设计[J].电子器件,2010,29(4),12.[10]陈弦.运算流水线的实现和优化[J].微电子学与计算机,2006,12(4),20.[11]TangTY,ChoyCS,SiuPL,etal.DesignofSelf-timedAsynchronusBooth’sMultiplier[J].IEEETransonDesignAutomationConference,2000,12(5),37.[12]NobelFW,Coox
6、PW.ElectricalPhaseShiftMultiplier[J].TheReviewOFScientificInstruments.1965,36(7),47.4、毕业论文(设计)进度安排:2012年11月:选定题目,查找资料,确定总体设计思路2012年12月:论文开题2013年2月:进行模块分析,动手设计并综合各模块2013年3月:进行软件仿真,对模块设计不妥之处及时更正2013年4月:动笔撰写论文初稿2013年4月下旬:修整和完善论文内容,交由指导老师评阅并最终定稿2013年5月中旬:制作PPT,完成毕业论文
7、答辩教研室意见:负责人签名:注:本任务书一式三份,由指导教师填写,经教研室审批后一份下达给学生,一份交指导教师,一份留系里存档。34湖南科技学院本科毕业论文(设计)开题报告书论文(设计)题目基于VerilogHDL的浮点运算器的研究与设计作者姓名曾红艳所属系、专业、年级电子工程系电子信息工程专业2009年级指导教师姓名、职称唐云讲师预计字数10000开题日期2012.12.25选题的根据:1)说明本选题的理论、实际意义2)综述国内外有关本选题的研究动态和自己的见解选题的意义:随着信息应用领域对数据运算精度要求的不断提高和
8、数值运算范围的不断扩大,当今CPU设计中,对浮点运算单元的研究显得越来越重要。运算器作为计算机数字信号处理的核心部件,是CPU的重要组成部分,它们的性能制约着整个系统的性能。大多数商用浮点运算库只提供一小部分具有固定位宽和运算速度的浮点模块,且价格较高。而在实际的工程运用中需要对运算库进行改进以满足实际需要。浮点数的
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