毕业设计（论文）-基于fpga的数字二进制解调模块的设计

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1、毕业设计（论文）设计（论文）题目：基于FPGA的数字二进制解调模块的设计摘要传统的通信系统大多数属于“硬件系统”，一种调制、解调技术必须有一套专用芯片与之配套，这在很大程度上限制了现代通信技术的发展。以通用的硬件平台为基础采用软件的方式来实现通信的功能在很大程度上打破了通信设备对硬件的过度依赖，同时也赋予通信设备更大的灵活性。可编程逻辑器件FPGA凭借其高速并行处理能力、灵活的可重构能力可在一套硬件设备上实现对多种调制、解调方式的兼容。本设计的核心器件FPGA均采用VHDL语言，在EDA开发环境Qua

2、rtusII平台下实现三种调制信号2ASK、2FSK、2DPSK的解调。其中，用过零检测法解调2ASK、2FSK信号，极性比较法解调2DPSK信号。经过时序仿真后，观察仿真波形可知是否满足设计要求以正确输出基带信号。【关键词】二进制幅移键控二进制频移键控二进制相对相移键控甚高速集成电路硬件描述语言毕业设计（论文）ABSTRACTMosttraditionalcommunicationsystembelongstothe“hardware”,butakindofmodulationanddemodula

3、tiontechnologymusthaveaspecialchiptomatch,thisislargelylimitsthedevelopmentofmoderncommunicationtechnology.Withthemethodofsoftwarewhichbasedonthegeneralhardwareplatformtorealizethecommunicationbreaksthecommunicationdeviceover-relianceonhardwarelargely,b

4、utalsomakecommunicationsequipmentmoreflexible.ProgrammablelogicdeviceFPGAwithitshigh-speedparallelprocessingcapabilities,flexiblereconfigurableabilitytoachieveavarietyofmodulationanddemodulationmethodonasetofcompatiblehardwaredevices.ThecoredeviceFPGAof

5、thisdesignadoptsVHDLlanguage,intheplatformQuartusIIofEDA’sdevelopmentenvironmenttorealizethedemodulationofthreemodulationsignal2ASK,2FSK,2DPSK.Amongthem,thezerodetectiontorealizethedemodulationof2ASK,2FSKsignal,polaritycomparisontorealizethedemodulation

6、of2DPSKsignal.Aftertimingsimulation,observethesimulationwaveformshowswhethermeetthedesignrequirementstooutputthebasebandsignalcorrectly.【Keywords】2ASK2FSK2DPSKVHDL毕业设计（论文）目录前言1第一章概述3第一节课题背景与研究现状3一、数字调制解调背景知识3二、FPGA背景知识4第二节EDA技术简介5一、QuartusII简介5二、VHDL简介7

7、第三节课题的主要研究工作8第四节本章小结8第二章2ASK解调模块的设计9第一节2ASK解调原理9一、过零检测法9第二节基于VHDL的2ASK解调器的建模10一、2ASK解调器的建模原理10二、2ASK解调器的建模设计11三、2ASK解调的VHDL程序仿真及分析12第三节本章小结13第三章2FSK解调模块的设计14第一节2FSK解调原理14一、2FSK解调方法14二、过零检测法14第二节基于VHDL的2FSK解调器的建模15一、2FSK解调器的建模原理15二、2FSK解调器的建模设计16三、2FSK解调

8、的VHDL程序仿真及分析17第三节本章小结18第四章2DPSK解调模块的设计19第一节2DPSK解调原理19一、二进制绝对相移键控和相对相移键控19二、2DPSK解调方法19-II-毕业设计（论文）第二节基于VHDL的2DPSK解调器的建模21一、2DPSK解调器的建模原理21二、2DPSK解调器的建模设计21三、2DPSK解调VHDL程序仿真及分析23第三节本章小结25结论27致谢28参考文献29附录31一、英文原文：31二、英文翻译：38三、源程序：