实验六 同步计数器的设计实验报告

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1、数字电路实验报告实验六同步计数器的设计学号：姓名：一、实验目的和要求1．熟悉JK触发器的逻辑功能。2．掌握用JK触发器设计同步计数器。二、实验仪器及器件仪器及器件名称型号数量数字电路实验箱DS99-1A1数字万用表DY21061双踪示波器CS-41351器件74LS73X2274LS32X2174LS08X22三、实验预习1、复习时序逻辑电路设计方法。⑴逻辑抽象，得出电路的状态转换图或状态转换表①分析给定的逻辑问题，确定输入变量、输出变量以及电路的状态数。通常都是取原因（或条件）作为输入逻辑变量，取结果作输出逻辑变量

2、。②定义输入、输出逻辑状态和每个电路状态的含意，并将电路状态顺序编号。③按照题意列出电路的状态转换表或画出电路的状态转换图。通过以上步骤将给定的逻辑问题抽象成时序逻辑函数。⑵状态化简①等价状态：在相同的输入下有相同的输出，并且转换到同一次态的两个状态。②合并等价状态，使电路的状态数最少。⑶状态分配①确定触发器的数目n。因为n个触发器共有种状态组合，所以为获得时序电路所需的M个状态，必须取＜②给每个电路状态规定对应的触发器状态组合。9数字电路实验报告⑷选定触发器类型，求出电路的状态方程、驱动方程和输出方程①根据器件的供

3、应情况与系统中触发器种类尽量少的原则谨慎选择使用的触发器类型。②根据状态转换图（或状态转换表）和选定的状态编码、触发器的类型，即可写出电路的状态方程、驱动方程和输出方程。⑸根据得到的方程式画出逻辑图⑹检查设计的电路能否自启动①电路开始工作时通过预置数将电路设置成有效状态的一种。②通过修改逻辑设计加以解决。⑺设计步骤简图图3设计步骤简图2、按实验内容设计逻辑电路画出逻辑图。设计思路详情见第六部分。电路图如下：9数字电路实验报告四、实验原理1．计数器的工作原理递增计数器----每来一个CP，触发器的组成状态按二进制代码规

4、律增加。递减计数器-----按二进制代码规律减少。双向计数器-----可增可减，由控制端来决定。2．集成J-K触发器74LS73⑴符号：图1J-K触发器符号⑵功能：表1J-K触发器功能表CPJK功能↓↓0000保持0011↓↓0100清零0110↓↓1001置位1011↓↓1101翻转1110⑶状态转换图：9数字电路实验报告图2J-K触发器状态转换图⑷特性方程：⑸注意事项：①在J-K触发器中，凡是要求接“1”的，一定要接高电平（例如5V），否则会出现错误的翻转。①触发器的两个输出负载不能过分悬殊，否则会出现误翻。②J

5、-K触发器的清零输入端在工作时一定要接高电平或连接到实验箱的清零端子。3．时序电路的设计步骤内容见实验预习。五、实验内容1．用J-K触发器和门电路设计一个特殊的12进制计数器，其十进制的状态转换图为：图412进制计数器状态转换图六、实验设计及数据与处理⑴设计在12进制同步计数器中，输出的状态只由前一周期的状态决定，而与外来输入无关，因此目标电路为Moore型。而数字电路只有0和1两种状态，因此目标电路要表达12种状态需要用4个变量、、、的16种组合中的12种。现定义十进制数01~12的对应二进制数为输出状态，可得目标

6、电路的状态转换表如下：表212进制同步计数器状态状态转换表CLK9数字电路实验报告100012001030011401005010160110701118100091001101010111011121100130001本实验选择J-K触发器，根据状态转换表以及J-K触发器特性方程：得到目标电路方程如下：输出方程：、、、驱动方程：Q0一个CP发生一次变化，因此。Q1每当Q0为1时，发生变化，因此。Q2在Q1Q0都为1以及12（即1100的时候）发生变化，因此J2=K2=Q1nQ0n+Q3nQ2nQ3在Q2Q1Q0都为

7、1的时候，以及12的时候发生变化，因此J3=K3=Q0nQ1nQ2n+Q3nQ2n。状态方程：9数字电路实验报告（2）由以上三种方程可以画出逻辑图如下：图512进制同步计数器设计（3）各输出端波形图1—4的输出9数字电路实验报告5—8的输出9—12的输出9数字电路实验报告然后继续到第一幅图，如此循环。CP与各输出端的波形图如下：七、实验心得与体会1、通过此次实验对于触发器的逻辑功能有了更深的了解，学会了用J—K触发器实现同步电路或者异步电路，并且可以用多种方法完成这次实验。除了上述方法，也可以采用四个触发器实现1——

8、15计数的电路，并对其进行改进，使其在13（即1101的时候），Q3Q2进行清零。当然，达到相同目的的J和K也是不唯一的。9数字电路实验报告2、在使用触发器前，要对其进行检查。具体方法是将J、K以及清零端接高电平，C1接CP，将Q接led灯，若灯每次状态都发生改变，则证明触发器没有问题。在实验中若是出现了问题，要进行故障检查。有以下的检查方法⑴