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时间：2021-04-17
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1、数字电路实验四组合逻辑电路设计一、所用器件74ls004-2输入与非门3片。7483四位二进制全加器一片。二、实验内容1.用4-2输入与非门7400设计一个无弃权表决器,在四人或三人表决为1时通过,否则不通过。要求按组合电路设计要求写出真值表、卡诺图、逻揖函数表达式、逻辑电路图和接线图；并用实验方法验证设计结果。要求：(1)用≤9个2输入与非门实现最简设计;(2)（略）设计对称性好,无竞争冒险的四人表决电路。2.用7483构成一个四位二进制全加器，实现7+6+0=？8+9+1=？它所能进行运算的最大数是多少？7483引脚图。748
2、3逻辑框图7483真值表。7483逻辑图。返回74ls00四二输入与非门引脚图与封装图返回四人表决电路设计ABCDF000000001000100001100100001010011000111110000100101010010111110001101111101111110000001001110010ABCD1101111000010010真值表卡诺图逻辑式及变换化简式为:F=ABC+ABD+ACD+BCD使用八个2输入与非门的设计消除竞争冒险的对称电路
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