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1、2011—2012学年第2学期闽江学院考试试卷考试课程:数字逻辑电路试卷类别:A卷B卷□考试形式:闭卷开卷□适用专业年级:10级电子信息工程、10级电子信息科学与技术、10电子科学与技术装订线班级姓名学号题号一二三四五总分得分一、单项选择题30%(共30分,第12、第13题每题3分,其它每题2分,把正确答案填入下面表格)得分题号12345678910答案BBCBABCBA题号1112131415答案ACDBD1、七段共阴极显示译码器,当译码器七个输出端状态为abcdefg=时(高点平有效),译码器输入状态(8421BCD码)应为(B)。A、0011;B、0110;C、0101
2、;D、01002、一个8选1数据选择器,其地址输入端(选择控制输入端)的个数应是(B)个。A、2;B、3;C、4;D、83、对于J-K触发器,若J=K,则可完成(C)触发器的逻辑功能。A、R-S;B、D;C、T;D、J-K4、多谐振荡器可产生(B)A、正弦波;B、矩形波;C、三角波;D、锯齿波5、只读存储器ROM的功能是(A)。A、只能读出存储器的内容且断电后仍保持;B、只能将信息写入存储器;C、可以随机读出或写入信息;D、只能读出存储器的内容且断电后信息全丢失6、用(B)片1k´4的ROM可以扩展实现8k´4ROM的功能。A、4;B、8;C、16;D、327、已知逻辑函数,
3、则Y的最简与或表达式为(C)。A、;B、;C、;D、8、TTL与非门扇出系数的大小反映了与非门(B)能力的大小。A、抗干扰;B、带负载;C、工作速度;D、应用范围9、Verilog语言设计一个二输入的与门,其核心语句为(A)A、Y=A&B;B、Y=A∣B;C、Y=A~B;D、Y=A︱∣B;11、下列说法不正确的是(A)A、当高电平表示逻辑0、低电平表示逻辑1时称为正逻辑;B、三态门输出端有可能出现三种状态(高阻态、高电平、低电平);C、OC门输出端直接连接可以实现正逻辑的线与运算;D、集电极开路的门称为OC门12、电路如下图(图中为上升沿JK触发器),触发器当前状态Q3Q2Q
4、1为“100”,请问在时钟作用下,触发器下一状态(Q3Q2Q1)为(C)A、“101”;B、“110”;C、“011”;D、“001”74LS191功能表 CPD0D1D2D3Q0 Q1 Q2 Q30 × × × d0d1d2d31 0 0 ↑ ××××1 0 1 ↑ ××××1 1 × × ××××d0 d1 d2 d3加法计数减法计数保持13、电路如下图,已知电路的当前状态Q3Q2Q1Q0为“1100”,74LS191具有异步置数的逻辑功能,请问在时钟作用下,电路的下一状态(Q3Q2Q1Q0)为(D)A、“1100”;B、“1011”;C、“11
5、01”;D、“0000”14、 函数F(A,B,C)=AB+BC+AC的最小项表达式为(B)。A、F(A,B,C)=∑m(0,2,4);B、F(A,B,C)=∑m(3,5,6,7);C、F(A,B,C)=∑m(0,2,3,4);D、F(A,B,C)=∑m(2,4,6,7)15、如图所示电路,若输入CP脉冲的频率为100KHz,则输出Q的频率为(D)。CPQQDCA、500KHz;B、200KHz;C、100KHz;D、50KHz二、填空题10%(每空1分,共10分。)得分1、时序逻辑电路按照其触发器是否有统一的时钟控制分为(同步)时序电路和(异步)时序电路。2、要表达一个逻辑
6、函数通常有:(函数表达式),(逻辑电路图),(真值表)等常见的方法。(写出其中三个即可:函数表达式,逻辑电路图,真值表,卡诺图,波形图)3、A/D转换是将模拟信号转换为数字信号,转换过程有:(取样)、(保持)、(量化)、(编码)。4、1是8421BCD码,其十进制为(861)。三、判断题10%(正确的打“√”,错误的打“×”,把答案填入下列表格,每题1分,共10分。)得分题号12345678910答案××√×√××√×√1、TTL、CMOS门中未使用的输入端均可悬空(×)2、TTL与非门与CMOS与非门的逻辑功能不一样。(×)3、计数器可作分频器。(√)4、因为逻辑表达式A+
7、B+AB=A+B成立,所以AB=0成立。(×)5、在时间和幅度上都断续变化的信号是数字信号,语音信号不是数字信号。(√)6、用数据选择器可实现时序逻辑电路。(×)7、单稳态触发器的暂稳态时间与输入触发脉冲宽度成正比。(×)8、相同逻辑功能的TTL电路和CMOS电路相比,前者的功耗大。(√)9、十进制数(9)10比十六进制数(9)16小。(×)10、若两个函数具有不同的真值表,则两个逻辑函数必然不相等。(√)四、化简8%得分1、(3分)用公式法化简下列函数:解:----------------------
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