显示译码器资料培训课件.ppt

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1、显示译码器资料七段数码显示器的两种结构形式：abcdefg（1）共阴结构abcdefg111与“1”电平驱动(输出高电平有效）的显示译码器配合使用；（2）共阳结构000abcdefgVCC与“0”电平驱动（输出低电平有效）的显示译码器配合使用。1、七段数码显示器fadge09abcdefg0123456789bc0110000110110111111101111001011001111100111111111七段数码显示器显示数字的情况：101101100111111110000共阴数码管2、集成显示译码器74HC4511（BCD七段显示译码器）12345

2、67816151413121110974HC4511输出：接数码显示器输入输入（1）外引线排列图控制端（2）逻辑符号74HC4511集成显示译码器CC145474线–7段译码器/驱动器CC14547的逻辑功能示意图CC14547BIDCBABIYgYfYeYdYcYbYa消隐控制端，低电平有效。8421码输入端译码驱动输出端，高电平有效。继续4线-7段译码器/驱动器CC14547真值表消隐000000001111消隐000000001111消隐000000010111消隐000000000111消隐000000011011消隐0000000010119110

3、011110011811111110001170000111111016111110001101511011011010141100110001013100111111001210110110100110000110100010011111100001消隐0000000××××0YgYfYeYdYcYbYaABCDBI数字显示输出输入4线-7段译码器/驱动器CC14547的逻辑功能示意图CC14547BIDCBABIYgYfYeYdYcYbYa0000000××××0消隐1111111111111111011101111011001111010101消隐消隐

4、消隐消隐消隐消隐987654321011001111111111000011111111001101101110011010011111011011000011001111111001000111100110101000101100010010000000允许数码显示伪码相应端口输出有效电平1，使显示相应数字。输入BCD码agfbc禁止数码显示继续集成显示译码器74LS48灯测试输入灭零输入灭灯输入／灭零输出RI为0时，使Ya--Yg=0，全灭RBI为0且A3～A0＝0时，使Ya-Yg=0，全灭控制端74LS48输入数据输出为0时，使Ya--Yg=1,亮“8”

5、：工作正常LT控制端：测试端LTRI：灭灯输入RBI：灭零输入端：灭零输出端RBO控制端功能电源＋5VRI/RBO74LS48GNDVcc地A3A2A1A0YaYbYdYfYeYgYcLTRBIRBO，当RBI＝0且A3～A0＝0时，=0;否则＝1RBORBO继续灭零输出接相邻位(靠中间)的灭零输入RBI和RBO配合使用，可使多位数字显示时的最高位及小数点后最低位的0不显示RBI为0且A3～A0＝0时，使Ya-Yg=0，全灭。RBO，当RBI＝0且A3～A0＝0时，=0；否则＝1RBORBOLS487RBIRBORBIRBORBIRBORBIRBORBIRBO

6、RBIRBORBIRBORBIRBORBIRBORBIRBO0056799000“1”“1”继续显示译码器74LS48与数码管的连接＋5Vabcdefg74LS48GNDVcc电源＋5VA3A2A1A0YaYbYdYfYeYgYcLTRIRBI输入信号BCD码继续74HC138用2片74HC138级联扩展成4线-16线译码器。4-16线译码器…………………①输出的问题：②输入的问题：译码器的应用－－1.级联(扩展)74HC138(1)①输出的问题：②输入的问题：74HC138(2)低位高位A3A2A1A0芯片工作情况00000111…………10001111……

7、……138(1)译码138(2)禁止138(1)禁止138(2)译码A0A1A2A31连完之后可再检查确认原理：二进制译码器输出能提供输入变量的全部最小项的反函数输出信号：任何组合逻辑函数都可以表示成为最小项之和的标准形式。译码器与非门mi组合逻辑函数译码器的应用－－2.用译码器实现组合逻辑函数设计步骤：(ⅰ)选择集成二进制译码器。待设计的逻辑函数的变量数目译码器输入代码的位数(ⅱ)将逻辑函数变换成标准的与非表达式。(ⅲ)确定输入变量与译码器输入端的对应关系，画连线图。则用译码器和与非门可以实现任意的m（mn）变量组合逻辑函数。如果译码器的输入代码位数为n，

8、74HC138试用3-8线译码器74H